组成原理课设报告.docx
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组成原理课设报告
计算机组成原理课程设计报告
班级:
班姓名:
315136649学号:
完成时间:
2017年1月3日
一、课程设计目的
1.在实验机上设计实现机器指令及对应的微指令(微程序)并验证,从而进一步掌握微程序设计控制器的基本方法并了解指令系统与硬件结构的对应关系;
2.通过控制器的微程序设计,综合理解计算机组成原理课程的核心知识并进一步建立整机系统的概念;
3.培养综合实践及独立分析、解决问题的能力。
二、课程设计的任务
针对COP2000实验仪,从详细了解该模型机的指令/微指令系统入手,以实现乘法和除法运算功能为应用目标,在COP2000的集成开发环境下,设计全新的指令系统并编写对应的微程序;之后编写实现乘法和除法的程序进行设计的验证。
三、课程设计使用的设备(环境)
1.硬件
●COP2000实验仪
●PC机
2.软件
●COP2000仿真软件
四、课程设计的具体内容(步骤)
1.详细了解并掌握COP2000模型机的微程序控制器原理,通过综合实验来实现
该模型机指令系统的特点:
COP2000模型机包括了一个标准CPU所具备所有部件,这些部件包括:
运算器ALU、累加器A、工作寄存器W、左移门L、直通门D、右移门R、寄存器组R0-R3、程序计数器PC、地址寄存器MAR、堆栈寄存器ST、中断向量寄存器IA、输入端口IN、输出端口寄存器OUT、程序存储器EM、指令寄存器IR、微程序计数器uPC、微程序存储器uM,以及中断控制电路、跳转控制电路。
其中运算器和中断控制电路以及跳转控制电路用CPLD来实现,其它电路都是用离散的数字电路组成。
微程序控制部分也可以用组合逻辑控制来代替。
模型机的指令码为8位,根据指令类型的不同,可以有0到2个操作数。
指令码的最低两位用来选择R0-R3寄存器,在微程序控制方式中,用指令码做为微地址来寻址微程序存储器,找到执行该指令的微程序。
而在组合逻辑控制方式中,按时序用指令码产生相应的控制位。
在本模型机中,一条指令最多分四个状态周期,一个状态周期为一个时钟脉冲,每个状态周期产生不同的控制逻辑,实现模型机的各种功能。
模型机有24位控制位以控制寄存器的输入、输出,选择运算器的运算功能,存储器的读写。
模型机的缺省的指令集分几大类:
算术运算指令、逻辑运算指令、移位指令、数据传输指令、跳转指令、中断返回指令、输入/输出指令。
模型机的寻址方式如下表所示:
表1.1模型机的寻址方式
模型机的寻址方式
寻址方式说明
指令举例
指令说明
累加器寻址
操作数为累加器A
CPLA
将累加器A的值取反
隐含寻址累加器A
OUT
将累加器A的值输出到输出端口寄存器OUT
寄存器寻址
参与运算的数据在R0~R3的寄存器中
ADDA,R0
将寄存器R0的值加上累加器A的值,再存入累加器A中
寄存器间接寻址
参与运算的数据在存储器EM中,数据的地址在寄存器R0-R3中
MOVA,@R1
将寄存器R1的值作为地址,把存储器EM中该地址的内容送入累加器A中
存储器直接寻址
参与运算的数据在存储器EM中,数据的地址为指令的操作数。
ANDA,40H
将存储器EM中40H单元的数据与累加器A的值作逻辑与运算,结果存入累加器A
立即数寻址
参与运算的数据为指令的操作数。
SUBA,#10H
从累加器A中减去立即数10H,结果存入累加器A
COP2000模型机指令的最低两位(IR0和IR1)用来寻址R0~R3四个寄存器;IR2和IR3与ELP微控制信号,Cy和Z两个程序状态信号配合,控制PC的置数,即程序的转移。
各种转移的条件判断逻辑如下所示:
当ELP=1时,不允许PC被预置
当ELP=0时
当IR3=1时,无论Cy和Z什么状态,PC被预置
当IR3=0时
若IR2=0,则当Cy=1时PC被预置
若IR2=1,则当Z=1时PC被预置
本模型机时序控制采用不定长机器周期的同步控制方式,一条指令最多分四个节拍。
系统提供的默认指令系统包括以下7类指令:
表1.2指令系统格式表
算术运算指令:
逻辑运算指令:
数据传输指令:
跳转指令:
ADDA,R?
ADDA,@R?
ADDA,MM
ADDA,#II
ADDCA,R?
ADDCA,@R?
ADDCA,MM
ADDCA,#II
SUBA,R?
SUBA,@R?
SUBA,MM
SUBA,#II
SUBCA,R?
SUBCA,@R?
SUBCA,MM
SUBCA,#II
ANDA,R?
ANDA,@R?
ANDA,MM
ANDA,#II
ORA,R?
ORA,@R?
ORA,MM
ORA,#II
CPLA
MOVA,R?
MOVA,@R?
MOVA,MM
MOVA,#II
MOVR?
A
MOV@R?
A
MOVMM,A
MOVR?
#II
JCMM
JZMM
JMPMM
CALLMMRET
移位指令:
中断返回指令:
输入/输出指令:
RRA
RLA
RRCA
RLCA
RETI
READMM
WRITEMM
IN
OUT
该模型机微指令系统的特点(包括其微指令格式的说明等):
该模型机的微命令是以直接表示法进行编码的,其特点是操作控制字段中的每一位代表一个微命令。
这种方法的优点是简单直观,其输出直接用于控制。
缺点是微指令字较长,因而使控制存储器容量较大。
模型机有24位控制位以控制寄存器的输入、输出,选择运算器的运算功能,存储器的读写。
微程序控制器由微程序给出24位控制信号,而微程序的地址又是由指令码提供的,也就是说24位控制信号是由指令码确定的。
该模型机的微指令的长度为24位,其中微指令中只含有微命令字段,没有微地址字段。
其中微命令字段采用直接按位的表示法,哪位为0,表示选中该微操作,而微程序的地址则由指令码指定。
这24位操作控制信号的功能如表2所示:
(按控制信号从左到右的顺序依次说明)
表1.3微指令控制信号的功能
操作控制信号
控制信号的说明
XRD
外部设备读信号,当给出了外设的地址后,输出此信号,从指定外设读数据。
EMWR
程序存储器EM写信号。
EMRD
程序存储器EM读信号。
PCOE
将程序计数器PC的值送到地址总线ABUS上。
EMEN
将程序存储器EM与数据总线DBUS接通,由EMWR和EMRD决定是将DBUS数据写到EM中,还是从EM读出数据送到DBUS。
IREN
将程序存储器EM读出的数据打入指令寄存器IR和微指令计数器μPC。
EINT
中断返回时清除中断响应和中断请求标志,便于下次中断。
ELP
PC打入允许,与指令寄存器的IR3、IR2位结合,控制程序跳转。
MAREN
将数据总线DBUS上数据打入地址寄存器MAR。
MAROE
将地址寄存器MAR的值送到地址总线ABUS上。
OUTEN
将数据总线DBUS上数据送到输出端口寄存器OUT里。
STEN
将数据总线DBUS上数据存入堆栈寄存器ST中。
RRD
读寄存器组R0~R3,寄存器R?
的选择由指令的最低两位决定。
RWR
写寄存器组R0~R3,寄存器R?
的选择由指令的最低两位决定。
CN
决定运算器是否带进位移位,CN=1带进位,CN=0不带进位。
FEN
将标志位存入ALU内部的标志寄存器。
X2
X2、X1、X0三位组合来译码选择将数据送到DBUS上的寄存器。
X1
X0
WEN
将数据总线DBUS的值打入工作寄存器W中。
AEN
将数据总线DBUS的值打入累加器A中。
S2
S2、S1、S0三位组合决定ALU做何种运算。
S1
S0
COP2000中有7个寄存器可以向数据总线输出数据,但在某一特定时刻只能有一个寄存器输出数据.由X2,X1,X0决定那一个寄存器输出数据。
表1.4寄存器选取
X2X1X0
输出寄存器
000
IN_OE外部输入门
001
IA_OE中断向量
010
ST_OE堆栈寄存器
011
PC_OEPC寄存器
100
D_OE直通门
101
R_OE右移门
110
L_OE左移门
111
没有输出
COP2000中的运算器由一片EPLD实现.有8种运算,通过S2,S1,S0来选择。
运算数据由寄存器A及寄存器W给出,运算结果输出到直通门D。
表1.5运算器操作选取
S2S1S0
功能
000
A+W加
001
A-W减
010
A|W或
011
A&W与
100
A+W+C带进位加
101
A-W-C带进位减
110
~AA取反
111
A输出A
2.计算机中实现乘法和除法的原理
(1)无符号乘法(4*4)
①算法流程图:
图2.1四位无符号乘法流程图
②硬件原理框图:
图2.2四位无符号乘法硬件原理图
(2)无符号除法(8/4)
①算法流程图:
图2.3四位无符号除法流程图
②硬件原理框图:
图2.4四位无符号除法硬件原理图
(3)无符号乘法(8*8)
①算法流程图:
图2.5八位无符号乘法流程图
②硬件原理框图:
图2.6八位无符号乘法硬件原理图
(4)无符号除法(16/8)
①算法流程图:
图2.7八位无符号除法流程图
②硬件原理框图:
图2.8八位无符号除法硬件原理图
(5)有符号乘法(4*4)
①算法流程图:
图2.9四位带符号乘法流程图图2.10符号判断处理子程序流程图
②硬件原理框图:
图2.11四位带符号乘法硬件原理图
3.对应于以上算法如何分配使用COP2000实验仪中的硬件
(初步分配,设计完成后再将准确的使用情况填写在此处)
(1)无符号乘法(4*4)
无符号乘法(4*4)对应于COP2000实验仪的硬件具体分配使用情况如下表所示:
表3.1无符号乘法的硬件分配情况
硬件名称
实现算法功能描述
寄存器R0
计算时用来存放部分积和最后的积
寄存器R1
初始化时,用来存放被乘数;
在程序执行的过程中,用来存放向左移位后的被乘数。
寄存器R2
初始化时,用来存放乘数;
在程序执行的过程中,用来存放向右移位后的乘数。
累加器A
执行ADDA,R?
(加法)、SHLR?
(左移一位)、SHRR?
(右移一位)等命令时所必须使用的寄存器。
寄存器W
执行ADDA,R?
(加法)、TESTR?
#II(测试R2的末位)等双操作数命令时所必须使用的寄存器。
左移门L
用来实现相应数据左移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
直通门D
用来控制ALU的执行结果是否输出到数据总线。
右移门R
用来实现相应数据右移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
程序计数器PC
控制程序按顺序正常执行;
当执行转移指令时,从数据线接收要跳转的地址,使程序能够按需要自动执行。
当要从EM中读取数据时,由PC提供地址。
存储器EM
存储指令和数据。
微程序计数器μPC
向微程序存储器μM提供相应微指令的地址。
微程序存储器μM
存储相应指令的微指令。
堆栈ST
当存储于累加器A的值将要受到破坏时,将其数据保存在堆栈ST中,使程序能够正常地执行。
(2)无符号除法(8/4)
无符号除法(8/4)对应于COP2000实验仪的硬件具体分配使用情况如下表所示:
表3.2无符号除法的硬件分配情况
硬件名称
实现算法功能描述
寄存器R0
初始化时,用来存放被除数和计算后的余数。
寄存器R1
①初始化时,用来存放除数;
②在程序执行的过程中,用来存放向右移位后的除数。
寄存器R2
在程序执行过程中,用来保存当前算得的商。
寄存器R3
当作计数器使用,用来控制程序是否结束(初始值5)。
累加器A
①计算时用来存放中间结果;
②执行ADDA,R?
(加法)、SUBA,R?
(减法)等命令时所必须使用的寄存器。
寄存器W
执行SUBA,R?
(减法)等双操作数命令时所必须使用的寄存器。
左移门L
用来实现相应数据左移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
直通门D
用来控制ALU的执行结果是否输出到数据总线。
右移门R
用来实现相应数据右移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
程序计数器PC
①控制程序按顺序正常执行;
②当执行转移指令时,从数据线接收要跳转的地址,使程序能够按需要自动执行。
③当要从EM中读取数据时,由PC提供地址。
存储器EM
存储指令和数据。
微程序计数器μPC
向微程序存储器μM提供相应微指令的地址。
微程序存储器μM
存储相应指令的微指令。
堆栈ST
当存储于累加器A的值将要受到破坏时,将其数据保存在堆栈ST中,使程序能够正常地执行。
(3)无符号乘法(8*8)
无符号乘法(8*8)对应于COP2000实验仪的硬件具体分配使用情况如下表所示:
表3.3无符号乘法(8*8)的硬件分配情况
硬件名称
实现算法功能描述
寄存器R0
计算时用来存放部分积和最后的积的高八位
寄存器R1
初始化时,用来存放乘数;
在程序执行的过程中,用来存放向右移位后并且接收了R0末位作为最高位的乘数;
程序结束时,该寄存器存放的是最后积的低八位。
寄存器R2
初始化时,用来存放被乘数。
寄存器R3
当作计数器使用,用来控制程序是否结束(初始值8)。
累加器A
执行ADDA,R?
(加法)、SHLR?
(左移一位)、SHRR?
(右移一位)等命令时所必须使用的寄存器。
寄存器W
执行ADDA,R?
(加法)、TESTR?
#II(测试R2的末位)等双操作数命令时所必须使用的寄存器。
左移门L
用来实现相应数据左移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
直通门D
用来控制ALU的执行结果是否输出到数据总线。
右移门R
用来实现相应数据右移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
程序计数器PC
控制程序按顺序正常执行;
当执行转移指令时,从数据线接收要跳转的地址,使程序能够按需要自动执行。
当要从EM中读取数据时,由PC提供地址。
存储器EM
存储指令和数据。
微程序计数器μPC
向微程序存储器μM提供相应微指令的地址。
微程序存储器μM
存储相应指令的微指令。
堆栈ST
当存储于累加器A的值将要受到破坏时,将其数据保存在堆栈ST中,使程序能够正常地执行。
(4)无符号除法(16/8)
无符号除法(16/8)对应于COP2000实验仪的硬件具体分配使用情况如下表所示:
表3.4无符号除法(16/8)的硬件分配情况
硬件名称
实现算法功能描述
寄存器R0
用来向EM中存取被除数的高八位和低八位。
寄存器R1
用来向EM中存取除数的高八位和低八位。
寄存器R2
在程序执行过程中,用来保存当前算得的商。
寄存器R3
当作计数器使用,用来控制程序是否结束(初始值9)。
存储器EM
存储指令和数据。
其中00H单元存放被除数的低八位;
01H单元存放被除数的高八位;
02H单元存放00H;
03H单元存放八位除数。
累加器A
①计算时用来存放中间结果;
②执行ADDA,R?
(加法)、SUBA,R?
(减法)等命令时所必须使用的寄存器。
寄存器W
执行SUBA,R?
(减法)等双操作数命令时所必须使用的寄存器。
左移门L
用来实现相应数据左移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
直通门D
用来控制ALU的执行结果是否输出到数据总线。
右移门R
用来实现相应数据右移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
程序计数器PC
①控制程序按顺序正常执行;
②当执行转移指令时,从数据线接收要跳转的地址,使程序能够按需要自动执行。
③当要从EM中读取数据时,由PC提供地址。
微程序计数器μPC
向微程序存储器μM提供相应微指令的地址。
微程序存储器μM
存储相应指令的微指令。
堆栈ST
当存储于累加器A的值将要受到破坏时,将其数据保存在堆栈ST中,使程序能够正常地执行。
(5)带符号乘法(4*4)
带符号乘法(4*4)对应于COP2000实验仪的硬件具体分配使用情况如下表所示:
表3.5带符号乘法(4*4)的硬件分配情况
硬件名称
实现算法功能描述
寄存器R0
计算时用来存放部分积和最后的积
寄存器R1
初始化时,用来存放被乘数;
在程序执行的过程中,用来存放向左移位后的被乘数。
寄存器R2
初始化时,用来存放乘数;
在程序执行的过程中,用来存放向右移位后的乘数。
寄存器R3
用来存放运算结果的符号位。
累加器A
执行ADDA,R?
(加法)、SHLR?
(左移一位)、SHRR?
(右移一位)等命令时所必须使用的寄存器。
寄存器W
执行ADDA,R?
(加法)、TESTR?
#II(测试R2的末位)等双操作数命令时所必须使用的寄存器。
左移门L
用来实现相应数据左移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
直通门D
用来控制ALU的执行结果是否输出到数据总线。
右移门R
用来实现相应数据右移一位的运算,并能够控制该运算后的结果是否输出到数据总线。
程序计数器PC
控制程序按顺序正常执行;
当执行转移指令时,从数据线接收要跳转的地址,使程序能够按需要自动执行。
当要从EM中读取数据时,由PC提供地址。
存储器EM
存储指令和数据。
微程序计数器μPC
向微程序存储器μM提供相应微指令的地址。
微程序存储器μM
存储相应指令的微指令。
堆栈ST
当存储于累加器A的值将要受到破坏时,将其数据保存在堆栈ST中,使程序能够正常地执行。
4.在COP2000集成开发环境下设计全新的指令/微指令系统
设计结果如表所示(可按需要增删表项)
(1)新的指令集
表4.1新指令集
助记符
机器码1
机器码2
指令说明
_FATCH_
000000xx
00-03
实验机占用,不可修改。
复位后,所有寄存器清0,首先执行_FATCH_指令取指。
MOV
R?
#II
000001xx
04-07
II
将立即数II存放到寄存器R?
中。
MOVA,R?
000010xx
08-0B
将寄存器R?
中的数放入累加器A中。
JMPMM
000011xx
0C-0F
MM
跳转到MM地址。
ADDR?
A
000100xx
10-13
将累加器A中的数加入到寄存器R?
中,并影响标志位。
TESTR?
#II
000101xx
14-17
II
寄存器R?
“与”立即数II,只改变标志位,并不改变R?
中的数值。
SHLR?
000110xx
18-1B
寄存器R?
中的数不带进位向左移一位,并不影响标志位。
SHRR?
000111xx
1C-1F
寄存器R?
中的数不带进位向右移一位,并不影响标志位。
JCMM
001000xx
20-23
MM
若进位标志位置1,跳转到MM地址。
JZMM
001001xx
24-27
MM
若零标志位为1,跳转到MM地址。
ED
001010xx
28-2B
程序结束。
ADD
R?
#II
001011xx
2C-2F
II
将立即数II加入到寄存器R?
中,并影响标志位。
SUBR?
A
001100xx
30-33
从寄存器R?
中减去累加器A中的数,并影响标志位。
SUB
R?
#II
001101xx
34-37
II
从寄存器R?
中减去立即数II,并影响标志位。
PUSHA
001110xx
38-3B
将累加器A中的数据压入堆栈寄存器ST。
POPA
001111xx
3C-3F
将堆栈寄存器ST中的数据弹出到累加器A中。
MOVMM,R?
010000xx
40-43
MM
将寄存器R?
中的数放入存贮器EM的MM地址单元中。
MOVR?
MM
010001xx
44-47
MM
将存贮器EM中地址为MM的数放入寄存器R?
中。
ADDCR?
A
010010xx
48-4B
将累加器A中的数“带进位加”入到寄存器R?
中,并影响标志位。
SUBCR?
A
010011xx
4C-4F
从寄存器R?
中“带进位减”去累加器A中的数,并影响标志位。
ANDR?
#II
010100xx
50-53
II
寄存器R?
“与”立即数II,改变标志位,并改变R?
中的数值。
ANDR?
A
010101xx
54-57
寄存器R?
“与”累加器A中的数据,改变标志位,并改变R?
中的数值。
ORR?
A
010110xx
58-5B
寄存器R?
“或”累加器A中的数据,改变标志位,并改变R?
中的数值。
(2)新的微指令集
表4.2新微指令集
助记符
状态
微地址
微程序
数据输出
数据打入
地址输出
运算器
移位控制
PC
PC
_FATCH_
T0
00
CBFFFF
指令寄存器IR
PC输出
A输出
写入
+1
01
FFFFFF
A输出
+1
02
FFFFFF
A输出
+1
03
FFFFFF
A输出
+1
MOVR?
#II
T1
04
C7FBFF
存贮器值EM
寄存器R?
PC输出
A输出
+1
+1
T0
05
CBFFFF
指令寄存器IR
PC输出
A输出
写入
+1
06
FFFFFF
A输出
+1
07
FFFFFF
A输出
+1
MOVA,R?
T1
08
FFF7F7
寄存器值R?
寄存器A
A输出
+1
T0
09
CBFFFF
指令寄存器IR
PC输出
A输出
写入
+1
0A
FFFFFF
A输出
0B
FFFFFF
A输出
JMPMM
T1
0C
C6FFFF
存贮器值EM
寄存器PC
PC输出
A输出
+1
写入
T0
0D
CBFFFF
指令寄存器IR
PC输出
A输出
写入
+1
0E
FFFFFF
A输出
+1
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