数字电路基础实验指导十个.docx
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数字电路基础实验指导十个
数字电路基础实验指导(十个)
基础实验部分
实验一集成逻辑门电路逻辑功能的测试
一、实验目的
1、熟悉数字逻辑实验箱的结构、基本功能和使用方法。
2、掌握常用非门、与非门、或非门、与或非门、异或门的逻辑功能及其测试方法。
二、实验仪器及设备
1、数字逻辑实验箱1台
2、元器件:
74LS0074LS0474LS5574LS86各一块
导线若干
三、实验内容
1、测试74LS04(六非门)的逻辑功能
将74LS04正确接入面包板,注意识别1脚位置(集成块正面放置且缺口向左,则左下角为1脚)重点讲解,按表1-1要求输入高、低电平信号,测出相应的输出逻辑电平。
得表达式为
表1-174LS04逻辑功能测试表
1A
1Y
2A
2Y
3A
3Y
4A
4Y
5A
5Y
6A
6Y
0
1
0
1
0
1
0
1
0
1
0
1
1
0
1
0
1
0
1
0
1
0
1
0
2、测试74LS00(四2输入端与非门)逻辑功能
将74LS00正确接入面包板,注意识别1脚位置,按表1-2要求输入高、低电平信号,测出相应的输出逻辑电平。
得表达式为
表1-274LS00逻辑功能测试表
1A
1B
1Y
2A
2B
2Y
3A
3B
3Y
4A
4B
4Y
0
0
1
0
0
1
0
0
1
0
0
1
0
1
1
0
1
1
0
1
1
0
1
1
1
0
1
1
0
1
1
0
1
1
0
1
1
1
0
1
1
0
1
1
0
1
1
0
3、测试74LS55(二路四输入与或非门)逻辑功能
将74LS55正确接入面包板,注意识别1脚位置,按表1-3要求输入信号,测出相应的输出逻辑电平,填入表中。
(表中仅列出供抽验逻辑功能用的部分数据)
表1-374LS55部分逻辑功能测试表
A
B
C
D
E
F
G
H
Y
0
0
0
0
0
0
0
0
1
0
0
0
0
0
0
0
1
1
0
0
0
0
0
0
1
0
1
0
0
0
0
0
0
1
1
1
0
0
0
0
0
1
0
0
1
0
0
0
0
0
1
0
1
1
0
0
0
0
0
1
1
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1
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0
0
0
0
1
1
1
1
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1
1
1
1
1
0
0
1
1
1
1
1
1
1
1
0
本器件的逻辑表达式应为:
Y=
与实侧值相比较,功能正确。
4、测试74LS86(四异或门)逻辑功能
将74LS86正确接入面包板,注意识别1脚位置,按表1-4要求输入信号,测出相应的输出逻辑电平。
得表达式为Y=A⊕B
表1-474LS86逻辑功能测试表
1A
1B
1Y
2A
2B
2Y
3A
3B
3Y
4A
4B
4Y
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
0
1
1
0
1
1
0
1
1
1
0
1
1
0
1
1
0
1
1
0
1
1
1
0
1
1
0
1
1
0
1
1
0
四、实验结果分析(回答问题)
若测试74LS55的全部数据,所列测试表应有256种输入取值组合。
用实验箱、万用表作一个实验示范,并强调测试方法及万用表的用法。
实验二组合逻辑电路的实验分析
一、实验目的
1、学会组合逻辑电路的实验分析方法。
2、验证半加器、全加器的逻辑功能。
二、实验仪器及设备
1、数字逻辑实验箱1台
2、元器件:
74LS00、74LS20各一块,74LS55、74LS86各一块
电阻及导线若干
三、实验线路图
四、实验内容
1、测试用与非门构成的电路的逻辑功能
按图3-1接线。
按下表要求输入信号,测出相应的输出逻辑电平,并填入表中。
分析电路的逻辑功能为半加器,写出逻辑表达式为:
Y=A⊕BZ=AB
2、测试用异或门和与非门组成的电路的逻辑功能
按图3-2接线。
按下表要求输入信号,测出相应的输出逻辑电平,并填入表中。
分析电路的逻辑功能为半加器,写出逻辑表达式为
Sn=A⊕BCn=AB
A
B
Y
Z
0
0
0
0
0
1
1
0
1
0
1
0
1
1
0
1
A
B
Sn
Cn
0
0
0
0
0
1
1
0
1
0
1
0
1
1
0
1
3、测试用异或门、非门和与或非门组成的电路的逻辑功能
按图3-3接线。
按下表要求输入信号,测出相应的输出逻辑电平,并填入表中。
分析电路的逻辑功能为半加器,写出逻辑表达式为:
Sn=A⊕B⊕CCn=AB+(A⊕B)C
An
Bn
Cn-1
Sn
Cn
0
0
0
0
0
0
0
1
1
0
0
1
0
1
0
0
1
1
0
1
1
0
0
1
0
1
0
1
0
1
1
1
0
0
1
1
1
1
1
1
五、实验结果分析(回答问题)
1、总结用实验来分析组合逻辑电路功能的方法为:
按图接线,将输入的所有取值组合对应输出测出来,得到该电路的真值表,进而写出逻辑函数表达式,概述电路的逻辑功能
讲解74LS138的用法及数据选择器在微机控制等领域的应用。
此为学生自拟实验由学生自拟,老师着重是辅导。
实验三数据选择器
一、实验目的
1、进一步熟悉用实验来分析组合逻辑电路功能的方法。
2、了解中规模集成4选1数据选择器74LS153的应用。
3、了解组合逻辑电路由小规模集成电路设计和由中规模集成电路设计的不同特点
二、实验仪器及设备
1、数字逻辑实验箱1台
2、元器件:
74LS00、74LS04各1块,74LS20、74LS153各1块
导线若干
三、实验线路图
四、实验内容(简单实验步骤、实验数据及波形)
1、利用数字逻辑实验箱测试74LS151八选一数据选择器的逻辑功能,按图5-1接线,将实验结果记录在下表中。
选通
地址输入
数据输入
输出
A2
A1
A0
D0
D1
D2
D3
D4
D5
D6
D7
Y
1
X
X
X
X
X
X
X
X
X
X
X
0
1
0
0
0
0
D0
X
X
X
X
X
X
X
D0
0
0
1
X
D1
X
X
X
X
X
X
D1
0
1
0
X
X
D2
X
X
X
X
X
D2
0
1
1
X
X
X
D3
X
X
X
X
D3
1
0
0
X
X
X
X
D4
X
X
X
D4
1
0
1
X
X
X
X
X
D5
X
X
D5
1
1
0
X
X
X
X
X
X
D6
X
D6
1
1
1
X
X
X
X
X
X
X
D7
D7
2、交通灯红用R、黄用Y、绿用G表示,亮为1,灭为0。
只有当其中一只亮时为正常Z=0,其余状态均为故障Z=1。
该交通灯故障报警电路如图5-1,接线并检查电路的逻辑功能,将结果记录在下表中,可得表达式为:
Z(R,Y,G)=∑m(0,3,5,6,7)
R
Y
G
Z
0
0
0
1
0
0
1
0
0
1
0
0
0
1
1
1
1
0
0
0
1
0
1
1
1
1
0
1
1
1
1
1
3、有一密码电子锁,锁上有四个锁孔A、B、C、D,按下为1,否则为0,当按下A和B、或A和D、或B和D时,再插入钥匙,锁即打开。
若按错了键孔,当插入钥匙时,锁打不开,并发出报警信号,有警为1,无警为0。
设计出电路如图5-3,按图接线并检查电路的逻辑功能,列出表述其功能的真值表,记录实验数据如下表,可得表达式为:
F(AB,C,D)=∑m(0,1,2,3,4,6,7,8,10,11,13,14,15)
A
B
C
D
F
A
B
C
D
F
0
0
0
0
1
1
0
0
0
1
0
0
0
1
1
1
0
0
1
0
0
0
1
0
1
1
0
1
0
1
0
0
1
1
1
1
0
1
1
1
0
1
0
0
1
1
1
0
0
0
0
1
0
1
0
1
1
0
1
1
0
1
1
0
1
1
1
1
0
1
0
1
1
1
1
1
1
1
1
1
五、实验结果分析(回答问题)
1、由以上实验测试结果,可知74LS151八选一的功能正常。
2、用中规模集成电路设计逻辑函数的特点为:
较小规模集成电路更便于修改设计,且设计中多使用最小项表达式,设计思想可以更加清晰。
讲解74LS151的用法及数据选择器在微机控制等领域的应用。
此为学生自拟实验由学生自拟,老师着重是辅导。
实验四触发器的功能及应用
一、实验目的
1、学会测试触发器逻辑功能的方法。
2、进一步熟悉RS触发器、集成JK触发器和D触发器的逻辑功能及触发方式。
3、进一步熟悉数字逻辑实验箱中单脉冲和连续脉冲发生器的使用方法。
二、实验仪器及设备
1、数字逻辑实验箱1台
2、双踪示波器XJ4328\XJ4318一台
3、元器件:
74LS00、74LS74各1块,74LS20、74LS76各1块
导线若干
三、实验线路图
四、实验内容(简单实验步骤、实验数据及波形)
1、基本RS触发器逻辑功能测试
利用数字逻辑实验箱测试由与非门组成的基本RS触发器的逻辑功能,R、S接电平开关,Q、Q接电平显示,将结果记录在下表中。
步骤
Q
功能
0
0
0
1
1
不定
1
0
1
0
1
置0
2
1
1
0
1
保持
3
1
0
1
0
置1
4
1
1
1
0
保持
2、集成JK触发器逻辑功能测试
CP
J
K
×
1
1
1
1→0
0
1
1
0→1
0
1
1→0
1
1
0
0→1
1
1
0
1→0
1→0
1
1
0→1
0→1
0/1
1/0
(1)直接置0和置1端的功能测试
(2)JK逻辑功能的测试
按下表测试并记录JK触发器的逻辑功能(表中CP信号由实验箱操作板上的单次脉冲发生器提供)。
J
K
CP
0
0
0→1
0/1
0/1
1→0
0/1
0/1
0
1
0→1
0/1
0/1
1→0
0/1
0
1
0
0→1
0/1
0/1
1→0
0/1
1
1
1
0→1
0/1
0/1
1→0
0/1
1/0
(3)JK触发器计数功能测试
使触发器处于计数状态(J=K=1),CP信号由实验箱操作板中的连续脉冲(矩形波)发生器提供,可分别用低频(f=1~10HZ)和高频(f=20~150KHZ)两档进行输入,分别用实验箱上的LED电平显示器和XJ4328双踪示波器观察工作情况,记录CP与Q的工作波形,Q状态更新发生在CP的下降沿。
Q信号的周期是CP信号周期的两倍。
3、集成D触发器逻辑功能测试
(1)D触发器逻辑功能的测试
按下表测试并记录D触发器的逻辑功能(表中CP信号由实验箱操作板上的单次脉冲发生器提供)。
D
CP
0
0→1
0/1
0
1→0
0/1
0/1
1
0→1
0/1
1
1→0
0/1
0/1
(2)D触发器计数功能测试
使触发器处于计数状态(D=),CP端由实验箱操作板中的连续脉冲(矩形波)发生器提供,可分别用低频(f=1-10HZ)和高频(f=20-150KHZ)两档进行输入,分别用实验箱上的LED电平显示器和XJ4318/XJ4328双踪示波器观察工作情况,记录CP与Q的工作波形,Q状态更新发生在CP的上升沿。
Q信号的周期是CP信号周期的两倍。
五、实验结果分析(回答问题)
1、画出工作波形图。
2、比较各种触发器的逻辑功能及触发方式:
基本RS触发器:
置0、置1、保持功能,有不定状态;低电平触发。
JK触发器:
置0、置1、保持、计数功能,有低电平有效的直接置0、置1端;下降沿触发。
D触发器:
置0、置1、保持、功能,有低电平有效的直接置0、置1端;上升沿触发。
六、思考题
将一个带直接置0/1端的JK触发器置为0有以下几种方法:
CP
J
K
×
×
×
1
0
↓
0
1
1
1
↓(1次或2次)
1
1
1
1
将一个带直接置0/1端的JK触发器置为1有以下几种方法:
CP
J
K
×
×
×
1
0
↓
1
0
1
1
↓(1次或2次)
1
1
1
1
将一个带直接置0/1端的D触发器置为0有以下几种方法:
CP
D
×
×
1
0
↓
0
1
1
↓(1次或2次)
1
1
将一个带直接置0/1端的D触发器置为1有以下几种方法:
CP
D
×
×
0
1
↓
1
1
1
↓(1次或2次)
1
1
讲解小规模计数器的应用及组成原理。
实验五计数器的功能及应用
一、实验目的
1、学习计数器逻辑功能的测试方法。
2、熟悉计数器(异步三位二进制加/减法及十进制加法)的工作原理。
二、实验仪器及设备
1、数字逻辑实验箱1台
2、万用表1只
3、双踪示波器XJ4328\XJ4318一台
4、元器件:
74LS00、74LS76各1块
导线若干
三、实验线路图
四、实验内容(简单实验步骤、实验数据及波形)
1、异步二进制加法计数器
按图8-1接线,组成一个三位异步二进制加法计数器,CP信号可利用数字逻辑实验箱上的单次脉冲发生器或低频连续脉冲发生器,清0信号
由逻辑电平开控制,计数器的输出信号接LED电平显示器,按下表进行测试并记录。
CP
Q3
Q2
Q1
十进制数
0
X
0
0
0
0
1
0
0
0
0
0
1
1
1
1
7
2
1
1
0
6
3
1
0
1
5
4
1
0
0
4
5
0
1
1
3
6
0
1
0
2
7
0
0
1
1
8
0
0
0
0
(2)在CP端加高频连续脉冲,用示波器观察各触发器输出端的波形,并按时间对应关系画出CP、Q1、Q2、Q3端的波形。
2、异步二进制减法计数器
在预习时画出用JK触发器构成的三位异步二进制减法计数器的逻辑电路如图8-2。
按图接线,然后按步骤1所述内容进行测试。
CP
Q4
Q3
Q2
Q1
Z
十进制数
0
X
0
0
0
0
0
0
1
0
0
0
0
0
0
0
1
0
0
0
1
0
1
2
0
0
1
0
0
2
3
0
0
1
1
0
3
4
0
1
0
0
0
4
5
0
1
0
1
0
5
6
0
1
1
0
0
6
7
0
1
1
1
1
7
8
1
1
0
0
0
8
9
1
0
0
1
1
9
10
0
0
0
0
0
0
3、异步十进制加法计数器
按图8-3接线,组成一个异步十进制加法计数器,CP信号可利用数字逻辑实验箱上的单次脉冲或低频连续脉冲发生器,清0信号
由逻辑电平开关控制,各触发器的输出端及进位输出端分别接到LED电平显示插孔,按下表进行测试并记录。
CP
Q4
Q3
Q2
Q1
Z
十进制数
0
X
0
0
0
0
0
0
1
0
0
0
0
0
0
0
1
0
0
0
1
0
1
2
0
0
1
0
0
2
3
0
0
1
1
0
3
4
0
1
0
0
0
4
5
0
1
0
1
0
5
6
0
1
1
0
0
6
7
0
1
1
1
1
7
8
1
1
0
0
0
8
9
1
0
0
1
1
9
10
0
0
0
0
0
0
(2)在CP端加高频连续脉冲,用示波器观察各触发器输出端的波形,并按时间对应关系画出CP、Q1、Q2、Q3、Q4、Z端的波形。
十进制计数器
五、实验结果分析(回答问题)
1、画出工作波形图。
二进制加/减法计数器的相同点:
都为异步计数器,进位信号取自低位状态的边沿。
相异点:
进位信号分别取自低位状态的下降沿和上升沿。
讲解中规模计数器的应用及组成原理。
实验六中规模集成计数器的应用
一、实验目的
1、熟悉中规模集成计数器的功能及应用。
2、进一步熟悉数字逻辑实验箱中的译码显示功能。
二、实验仪器及设备
1、数字逻辑实验箱1台
2、万用表1只
3、双踪示波器XJ4328/XJ4318一台
4、元器件:
74LS00、74LS20、74LS161各1块
导线若干
三、实验线路图
四、实验内容(简单实验步骤、实验数据及波形)
(一)用74LS161及辅助门电路实现一个10进制计数器:
1、利用异步清0端
。
电路图如图9-1。
2、利用同步置数端
,从0000开始计数。
电路图如图9-2。
3、利用同步置数端
,到1111结束。
电路图如图9-3。
4、利用同步置数端
,从某状态DCBA开始,到另一状态D1C1B1A1结束。
(例:
从0001开始,到1010结束的10进制)电路图如图9-4。
计数器的CP端接低频连续脉冲,输出状态接LED电平显示,逻辑电平开关作为并行输入数据,观察计数器的功能。
列出表述其功能的计数状态顺序表,记录实验数据。
电路图9-1、图9-2数据为下表:
CP
QD
QC
QB
QA
十进制数
0
0
0
0
0
0
1
0
0
0
1
1
2
0
0
1
0
2
3
0
0
1
1
3
4
0
1
0
0
4
5
0
1
0
1
5
6
0
1
1
0
6
7
0
1
1
1
7
8
1
0
0
0
8
9
1
0
0
1
9
10
0
0
0
0
0
电路图9-3的数据为下表:
CP
QD
QC
QB
QA
十进制数
0
0
1
1
0
6
1
0
1
1
1
7
2
1
0
0
0
8
3
1
0
0
1
9
4
1
0
1
0
10
5
1
0
1
1
11
6
1
1
0
0
12
7
1
1
0
1
13
8
1
1
1
0
14
9
1
1
1
1
15
10
0
0
0
0
0
电路图9-4的数据为下表:
CP
QD
QC
QB
QA
十进制数
0
0
0
0
1
1
1
0
0
1
0
2
2
0
0
1
1
3
3
0
1
0
0
4
4
0
1
0
1
5
5
0
1
1
0
6
6
0
1
1
1
7
7
1
0
0
0
8
8
1
0
0
1
9
9
1
0
1
0
10
10
0
0
0
0
0
(二)利用实验箱上的高频连续脉冲作CP,用示波器观察QD、QC、QB、QA的波形,并按时间对应关系记录下来。
(略)
五、实验结果分析(回答问题)
1、74LS161的置0端为异步置0,置数端为同步置数。
2、若要求计数器具有暂停计数功能,可以:
A封锁CP信号
B令EP=ET=0
此为学生自拟实验由学生自拟,老师着重辅导。
实验七计数、译码、显示综合实验
一、实验目的
1、熟悉中规模集成电路计数器的功能及应用。
2、熟悉中规模集成电路译码器的功能及应用。
3、熟悉LED数码管及显示电路的工作原理。
4、学会综合测试的方法。
二、实验仪器及设备
1、数字逻辑实验箱1台
2、元器件:
74LS902块
74LS49(或74LS249)1块
共阴型LED数码管1块
导线若干
三、实验线路图
四、实验内容(简单实验步骤、实验数据及波形
用集成计数器74LS90分别组成8421码十进制和六进制计数器,然后连接成一个60进制计数器(6进制为高位、10进制为低位)。
其中10进制计数器用实验箱上的LED译码显示电路显示(注意高低位顺序及最高位的处理),6进制计数器由自行设计、安装的译码器、数码管电路显示,这样组成一个60进制的计数、译码、显示电路。
用实验箱上的低频连续脉冲(调节频率为1-2HZ)作为计数器的计数脉冲,通过数码管观察计数、译码、显示电路的功能为正确。
五、实验结果分析
1、简要说明数码管自动计数显示的情况:
该计数器从00递增加1,直到59后,又回到00状态。
2、
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