计算机软件及应用arm体系结构..pptx
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计算机软件及应用arm体系结构..pptx
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使用ARM与普通单片机开发的产品(以太网串口转换模块),ARM,51,1.从用户的角度看:
使用ARM的模块体积更小巧、功能更全、速度更快、价格相对更高;2.从设计人员的角度看:
ARM芯片具有丰富外设,减少外部器件可以增加系统可靠性,降低硬件设计上的难度。
ARM速度快,可以弥补算法的上不足,使程序编写更轻松。
3.从商业的角度看:
使用ARM的模块,产品附加值更高,利润更高。
ARM与普通单片机开发产品的比较,电脑打铃器原理图,LPC2132最小系统,1.对比已经掌握的CPU类型来学习ARM结构和指令系统:
体系结构和指令系统是一款处理器的灵魂,对它们的细致了解,对于应用和操作系统的移植都有很大的益处;2.选择合适的芯片来学习具体ARM芯片的结构:
选择一款简单的ARM芯片,可以降低入门难度而不影响对ARM的学习。
3.选择合适的开发板来动手实践:
理论联系实践可以更高效快速的掌握理论知识以及软硬件开发流程等。
4.选择难度合适的工程应用:
ARM的学习,开始我们的ARM之旅,当前位置,ARM7体系结构,(第二版),第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,2.1ARM简介,ARM公司简介,ARM是AdvancedRISCMachines的缩写,它是一家微处理器行业的知名企业,该企业设计了大量高性能、廉价、耗能低的RISC(精简指令集)处理器。
公司的特点是只设计芯片,而不生产。
它将技术授权给世界上许多著名的半导体、软件和OEM厂商,并提供服务。
2.1ARM简介,ARM公司简介,ARM已成为中国嵌入式开发首选,电脑打铃器原理图,LPC2000微控制器内部结构,2.1ARM简介,ARM体系结构,ARM处理器为RISC芯片,其简单的结构使ARM内核非常小,这使得器件的功耗也非常低。
它具有经典RISC的特点:
寄存器:
具有更多的通用寄存器;装载/保存结构:
处理器操作只针对寄存器的内容,而不直接对存储器进行操作;流水线:
将指令处理过程分为多步,提高效率;指令长度:
统一长度的指令域,简化指令译码。
2.1ARM简介,ARM体系结构,ARM体系结构的特点,使其非常适用于嵌入式系统:
低功耗:
对于电池供电的设备,功耗无疑是重点;高代码密度:
小的代码量可以减小存储成本;小面积:
芯片内可以集成更多的外设,使系统硬件更紧凑简洁;方便的硬件调试技术:
降低开发难度和成本。
2.1ARM简介,各ARM体系结构版本,ARM体系结构从最初开发到现在有了巨大的改进,并仍在完善和发展。
为了清楚的表达每个ARM应用实例所使用的指令集,ARM公司定义了6种主要的ARM指令集体系结构版本,以版本号V1V6表示。
其中V1V3已经停止使用,常用的ARM7为V4版本。
2.1ARM简介,各ARM体系结构版本V4,不在为了与以前的版本兼容而支持26位体系结构,并明确了哪些指令会引起未定义指令异常发生,它相对V3版本作了以下的改进:
增加半字加载/存储指令;字节和半字的加载和符号扩展指令;具有可以转换到Thumb状态的指令;增加使用用户模式寄存器的系统模式。
2.1ARM简介,各ARM体系结构版本V5,在V4版本的基础上,对现在指令的定义进行了必要的修正,对V4版本的体系结构进行了扩展并并增加了指令,具体如下:
改进了ARM/Thumb状态之间的切换效率;允许非T变量和T变量一样,使用相同的代码生成技术;增加计数前导零指令和软件断点指令;对乘法指令如何设置标志作了严格的定义。
2.1ARM简介,ARM处理器核简介,ARM公司开发了很多系列的ARM处理器核,目前最新的系列已经是ARM11了,而ARM6核以及更早的系列已经很罕见了。
目前应用比较广泛的系列是:
2.1ARM简介,ARM处理器核简介ARM7,该系列包括ARM7TDMI、ARM7TDMI-S、带有高速缓存处理器宏单元的ARM720T和扩充了Jazelle的ARM7EJ-S。
该系列处理器提供Thumb16位压缩指令集和EmbededICE软件调试方式,适用于更大规模的SoC设计中。
ARM7系列广泛应用于多媒体和嵌入式设备,包括Internet设备、网络和调制解调器设备,以及移动电话、PDA等无线设备。
2.1ARM简介,ARM处理器核简介ARM9,该系列包括ARM9TDMI、ARM920T、ARM926和带有高速缓存处理器宏单元的ARM940T。
除了兼容ARM7系列,而且能够更加灵活的设计。
PHILIPS最近推出的LPC3180就是基于ARM926的微处理器,即将推出的开发套件SmartARM3180支持Linux2.4、WinCE4.2,还有PC104等工控机系列产品。
ARM9系列主要应用于引擎管理、仪器仪表、安全系统和机顶盒等领域。
2.1ARM简介,ARM处理器核简介Cortex-M3,该系列主要针对MCU市场,改进了代码密度,减少了中断延迟,并有更低的功耗,支持Thumb-2指令集。
开发套件:
KeilRealView(包含ULINK仿真器),支持ARM7、ARM9以及CortexM3,ADS将停止支持CortexM3,预计市场上第一颗基于CortexM3的MCU将于第四季度上市。
第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,2.2ARM7TDMI,简介,ARM7TDMI基于ARM体系结构V4版本,是目前低端但非常流行的ARM核,具有非常好的性能-功耗比。
应用很广泛,其最显著的应用为数字移动电话。
注意:
“ARM核”并不是芯片,ARM核与其它部件如RAM、ROM、片内外设组合在一起才能构成现实的芯片。
2.2ARM7TDMI,简介,ARM7TDMI支持32位寻址范围,并弥补了ARM6不能在低于5V电源电压下工作的不足。
ARM7TDMI的后缀意义为:
2.2ARM7TDMI,简介,ARM7TDMI处理器是ARM通用32位微处理器家族的成员之一。
它具有优异的性能,但功耗却很低,使用门的数量也很少。
它属于精简指令集计算机(RISC),比复杂指令集计算机(CISC)要简单得多。
这样的简化实现了:
高的指令吞吐量;出色的实时中断响应;小的、高性价比的处理器宏单元。
2.2ARM7TDMI,三级流水线,ARM7TDMI处理器使用流水线来增加处理器指令流的速度。
这样可使几个操作同时进行,并使处理和存储器系统连续操作,能提供0.9MIPS/MHz的指令执行速度。
ARM7TDMI的流水线分3级,分别为:
取指译码执行,2.2ARM7TDMI,三级流水线,2.2ARM7TDMI,三级流水线,1.从地址
(1)预取指;,2.2ARM7TDMI,三级流水线,1.从地址
(1)预取指;,2.从地址
(2)预取指,“LDR”指令进入译码阶段;,2.2ARM7TDMI,三级流水线,内核流水性,1.从地址
(1)预取指;,2.从地址
(2)预取指,“LDR”指令进入译码阶段;,3.从地址(3)预取指,“STR”指令进入译码阶段,同时“LDR”指令进入执行阶段;,2.2ARM7TDMI,存储器访问,ARM7TDMI处理器使用了冯诺依曼(VonNeumann)结构,指令和数据共用一条32位总线。
只有装载、存储和交换指令可以对存储器中的数据进行访问。
数据可以是字节(8位)、半字(16位)或者字(32位)。
2.2ARM7TDMI,存储器访问,半字:
连续的两字节数据构成一个半字;字:
连续的四字节数据构成一个字;,2.2ARM7TDMI,存储器访问,半字对齐:
当数据的起始地址为偶数时;字对齐:
当数据的起始地址可以被4整除时;,2.2ARM7TDMI,存储器访问,Thumb指令为半字长度,必须按半字对齐存放;ARM指令为字长度,必须按字对齐存放。
2.2ARM7TDMI,存储器访问,第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,2.3ARM7TDMI的模块和内核框图,2.3ARM7TDMI的模块和内核框图,2.3ARM7TDMI的模块和内核框图,第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,2.5处理器状态,处理器状态,ARM7TDMI处理器内核使用V4T版本的ARM结构,该结构包含32位ARM指令集和16位Thumb指令集。
因此ARM7TDMI处理器有两种操作状态:
ARM状态:
32位,这种状态下执行的是字方式的ARM指令;Thumb状态:
16位,这种状态下执行半字方式的Thumb指令。
注意:
两个状态之间的切换并不影响处理器模式或寄存器内容。
ARM指令集效率高,但是代码密度低;而Thumb指令集具有较高的代码密度,却仍然保持ARM的大多数性能上的优势,它是ARM指令集的子集。
(详见第4章),ARM,Thumb,2.5处理器状态,处理器状态,使用BX指令将ARM7TDMI内核的操作状态在ARM状态和Thumb状态之间进行切换(详见第4章),程序如下所示。
;从ARM状态切换到Thumb状态LDRR0,=Lable+1BXR0;从Thumb状态切换到ARM状态LDRR0,=LableBXR0,地址最低位为1,表示切换到Thumb状态,地址最低位为0,表示切换到ARM状态,跳转地址标号,第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,2.6处理器模式,简介,ARM体系结构支持7种处理器模式,分别为:
用户模式、快中断模式、中断模式、管理模式、中止模式、未定义模式和系统模式。
使用这些模式的好处是可以更好的支持操作系统并提高工作效率。
ARM7TDMI完全支持这七种模式。
2.6处理器模式,处理器模式,2.6处理器模式,特权模式,除用户模式外,其它模式均为特权模式。
ARM内部寄存器和一些片内外设在硬件设计上只允许(或者可选为只允许)特权模式下访问。
此外,特权模式可以自由的切换处理器模式,而用户模式不能直接切换到别的模式。
2.6处理器模式,异常模式,这五种模式称为异常模式。
它们除了可以通过程序切换进入外,也可以由特定的异常进入。
当特定的异常出现时,处理器进入相应的模式。
每种异常模式都有一些独立的寄存器,以避免异常退出时用户模式的状态不可靠。
2.6处理器模式,用户和系统模式,这两种模式都不能由异常进入,而且它们使用完全相同的寄存器组。
系统模式是特权模式,不受用户模式的限制。
操作系统在该模式下访问用户模式的寄存器就比较方便,而且操作系统的一些特权任务可以使用这个模式访问一些受控的资源。
第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,2.7内部寄存器,简介,在ARM7TDMI处理器内部有37个用户可见的寄存器。
在不同的工作模式和处理器状态下,程序员可以访问的寄存器也不尽相同。
ARM状态各模式下的寄存器,ARM状态各模式下可以访问的寄存器,ARM状态各模式下的寄存器,所有的37个寄存器,分成两大类:
31个通用32位寄存器;6个状态寄存器。
一般的通用寄存器,在汇编语言中寄存器R0R13为保存数据或地址值的通用寄存器。
它们是完全通用的寄存器,不会被体系结构作为特殊用途,并且可用于任何使用通用寄存器的指令。
一般的通用寄存器,其中R0R7为未分组的寄存器,也就是说对于任何处理器模式,这些寄存器都对应于相同的32位物理寄存器。
一般的通用寄存器,寄存器R8R14为分组寄存器。
它们所对应的物理寄存器取决于当前的处理器模式,几乎所有允许使用通用寄存器的指令都允许使用分组寄存器,一般的通用寄存器,寄存器R8R12有两个分组的物理寄存器。
一个用于除FIQ模式之外的所有寄存器模式,另一个用于FIQ模式。
这样在发生FIQ中断后,可以加速FIQ的处理速度。
一般的通用寄存器,寄存器R13、R14分别有6个分组的物理寄存器。
一组用于用户和系统模式,其余5组分别用于5种异常模式。
堆栈指针寄存器R13(SP),寄存器R13常作为堆栈指针(SP)。
在ARM指令集当中,没有以特殊方式使用R13的指令或其它功能,只是习惯上都这样使用。
但是在Thumb指令集中存在使用R13的指令。
链接寄存器R14(LR),R14为链接寄存器(LR),在结构上有两个特殊功能:
在每种模式下,模式自身的R14版本用于保存子程序返回地址;当发生异常时,将R14对应的异常模式版本设置为异常返回地址(有些异常有一个小的固定偏移量)。
2.7内部寄存器,R14寄存器与子程序调用,MOVPC,LR,R14(地址A),1.程序A执行过程中调用程序B;,操作流程,2.程序跳转至标号Lable,执行程序B。
同时硬件将“BLLable”指令的下一条指令所在地址存入R14;,3.程序B执行最后,将R14寄存器的内容放入PC,返回程序A;,2.7内部寄存器,R14寄存器与异常发生,异常发生时,程序要跳转至异常服务程序,对返回地址的处理与子程序调用类似,都是由硬件完成的。
区别在于有些异常有一个小常量的偏移。
程序计数器R15(PC),寄存器R15为程序计数器(PC),它指向正在取指的地址。
可以认为它是一个通用寄存器,但是对于它的使用有许多与指令相关的限制或特殊情况。
如果R15使用的方式超出了这些限制,那么结果将是不可预测的。
2.7内部寄存器,读R15的限制,正常操作时,从R15读取的值是处理器正在取指的地址,即当前正在执行指令的地址加上8个字节(两条ARM指令的长度)。
由于ARM指令总是以字为单位,所以R15寄存器的最低两位总是为0。
MOVR0,PCADDSUB,2.7内部寄存器,读R15的限制,内核流水线取指译码执行,SUB,ADD,MOV,程序代码,PC-8PC-4PC,地址,注意:
执行一条PC读取指令时,读取的值并不是该行指令的地址值。
0x4000ADDPC,PC,#40x40040x40080x400C,思考与练习,?
假设CPU正在运行以下的程序,并正在执0x4000处的指令(它的作用是将PC值加4后写入PC),请问指令执行后PC值是什么?
PC=PC+4,2.7内部寄存器,读R15的限制,当使用STR或STM指令保存R15时,会有一个例外。
这些指令可能将当前指令地址加8字节或加12字节保存(将来可能还有其它数字)。
偏移量是8还是12取决于具体的ARM芯片,但是对于一个确定的芯片,这个值是一个常量。
所以最好避免使用STR和STM指令来保存R15,如果很难做到,那么应当在程序中计算出该芯片的偏移量。
2.7内部寄存器,读R15的限制,计算偏移量程序代码:
SUBR1,PC,#4;R1=下面STR指令的地址STRPC,R0;保存STR指令地址+偏移量LDRR0,R0;然后重装SUBR0,R0,R1;计算偏移量,2.7内部寄存器,写R15的限制,正常操作时,写入R15的值被当作一个指令地址,程序从这个地址处继续执行(相当于执行一次无条件跳转)。
2.7内部寄存器,写R15的限制,由于ARM指令以字为边界,因此写入R15的值最低两位通常为0b00。
具体的规则取决于内核结构的版本:
在ARM结构V3版及以下版本中,写入R15的值的最低两位被忽略,因此跳转地址由指令的实际目标地址(写入R15的值)和0xFFFFFFFC相与得到;在ARM结构V4版及以上版本中,写入R15的值的最低两位为0,如果不是,结果将不可预测。
程序状态寄存器CPSR,寄存器CPSR为程序状态寄存器,在异常模式中,另外一个寄存器“程序状态保存寄存器(SPSR)”可以被访问。
每种异常都有自己的SPSR,在因为异常事件而进入异常时它保存CPSR的当前值,异常退出时可通过它恢复CPSR。
详细描述参看2.8小节。
2.7内部寄存器,Thumb状态寄存器,Thumb状态寄存器集是ARM状态集的子集,程序员可以直接访问的寄存器为:
8个通用寄存器R0R7;程序计数器(PC);堆栈指针(SP);链接寄存器(LR);有条件访问程序状态寄存器(CPSR)。
Thumb状态各模式下的寄存器,注意:
括号内为ATPCS中寄存器的命名,可以使用RN汇编伪指令将寄存器定义多个名字。
其中ADS1.2的汇编程序直接支持这些名称,但注意a1a4,v1v4必须用小写。
Thumb状态下的通用寄存器,在汇编语言中寄存器R0R7为保存数据或地址值的通用寄存器。
对于任何处理器模式,它们中的每一个都对应于相同的32为物理寄存器。
它们是完全通用的寄存器,不会被体系结构作为特殊的用途,并且可用于任何使用通用寄存器的指令。
Thumb状态下的堆栈指针寄存器(SP),堆栈指针SP对应ARM状态的寄存器R13。
每个异常模式都有其自身的SP分组版本,SP通常指向各异常模式所专用的堆栈。
注意:
在发生异常时,处理器自动进入ARM状态。
Thumb状态下的链接寄存器R14(LR),链接寄存器LR对应ARM状态寄存器R14,在结构上有两个特殊功能,详见“ARM状态下的链接寄存器LR”。
注意:
在发生异常时,处理器自动进入ARM状态。
2.7内部寄存器,ARM状态和Thumb状态之间寄存器的关系,Thumb状态寄存器与ARM状态寄存器有如下的关系:
Thumb状态R0R7与ARM状态R0R7相同;Thumb状态CPSR与ARM状态CPSR相同;Thumb状态SP映射到ARM状态R13;Thumb状态LR映射到ARM状态R14;Thumb状态PC映射到ARM状态PC(R15)。
Thumb状态寄存器在Arm状态寄存器上的映射,低寄存器,高寄存器,2.7内部寄存器,在Thumb状态中访问高寄存器,在Thumb状态中,高寄存器(R8R15)不是标准寄存器集的一部分。
汇编语言程序员对它们的访问受到限制,但可以将它们用于快速暂存。
可以使用MOV、CMP和ADD指令对高寄存器操作,详见第4章。
第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,2.8程序状态寄存器,简介,ARM7TDMI内核包含1个CPSR和5个供异常处理程序使用的SPSR。
CPSR反映了当前处理器的状态,其包含:
4个条件代码标志(负(N)、零(Z)、进位(C)和溢出(V));2个中断禁止位,分别控制一种类型的中断;5个对当前处理器模式进行编码的位;1个用于指示当前执行指令(ARM还是Thumb)的位。
2.8程序状态寄存器,简介,条件代码标志,保留,控制位,溢出标志,进位或借位扩展,零,负或小于,IRQ禁止,FIQ禁止,状态位,模式位,N,Z,C,V,I,T,F,CPSR寄存器的格式,2.8程序状态寄存器,简介,每个异常模式还带有一个程序状态保存寄存器(SPSR),它用于保存在异常事件发生之前的CPSR。
CPSR和SPSR通过特殊指令进行访问。
详细信息请参阅第3章。
注意:
如果通过程序修改CPSR寄存器中的模式位进入异常模式,那么硬件将不会把CPSR保存至SPSR中。
2.8程序状态寄存器,条件代码标志,大多数“数值处理指令”可以选择是否影响条件代码标志位。
通常如果指令带S后缀,则该指令的执行会影响条件代码标志;但有一些指令的执行总是会影响条件代码标志。
N、Z、C和V位都是条件代码标志。
通过算术操作、逻辑操作、MSR或者LDM指令可以对这些位进行设置。
所有ARM指令都可按条件来执行,而Thumb指令中只有分支指令可按条件执行。
2.8程序状态寄存器,条件代码标志,各标志位的含义如下:
N运算结果的最高位反映在该标志位。
对于有符号二进制补码,结果为负数时N=1,结果为正数或零时N=0;Z指令结果为0时Z=1(通常表示比较结果“相等”),否则Z=0;,2.8程序状态寄存器,条件代码标志,各标志位的含义如下:
C当进行加法运算(包括CMN指令),并且最高位产生进位时C=1,否则C=0。
当进行减法运算(包括CMP指令),并且最高位产生借位时C=0,否则C=1。
对于结合移位操作的非加法/减法指令,C为从最高位最后移出的值,其它指令C通常不变;V当进行加法/减法运算,并且发生有符号溢出时V=1,否则V=0,其它指令V通常不变。
2.8程序状态寄存器,控制位,CPSR的最低8位为控制位,当发生异常时,这些位被硬件改变。
当处理器处于一个特权模式时,可用软件操作这些位。
它们分别是:
中断禁止位;T位;模式位。
2.8程序状态寄存器,控制位,中断禁止位包括I和F位:
当I位置位时,IRQ中断被禁止;当F位置位时,FIQ中断被禁止。
T位反映了正在操作的状态:
当T位置位时,处理器正在Thumb状态下运行;当T位清零时,处理器正在ARM状态下运行。
2.8程序状态寄存器,控制位,模式位包括M4、M3、M2、M1和M0,这些位决定处理器的操作模式。
注意:
不是所有模式位的组合都定义了有效的处理器模式,如果使用了错误的设置,将引起一个无法恢复的错误。
CPSR模式位设置表,2.8程序状态寄存器,保留位,CPSR中的保留位被保留将来使用。
为了提高程序的可移植性,当改变CPSR标志和控制位时,请不要改变这些保留位。
另外,请确保您程序的运行不受保留位的值影响,因为将来的处理器可能会将这些位设置为1或者0。
第2章目录,1.简介2.ARM7TDMI3.ARM7TDMI的模块和内部框图4.体系结构直接支持的数据类型5.处理器状态6.处理器模式,7.内部寄存器8.程序状态寄存器9.异常10.中断延迟11.复位12.存储器及存储器映射I/O,2.9异常,简介,只要正常的程序流被暂时中止,处理器就进入异常模式。
例如响应一个来自外设的中断。
在处理异常之前,ARM7TDMI内核保存当前的处理器状态,这样当处理程序结束时可以恢复执行原来的程序。
如果同时发生两个或更多异常,那么将按照固定的顺序来处理异常,详见“异常优先级”部分。
2.9异常,异常的入口和出口处理,如果异常处理程序已经把返回地址拷贝到堆栈,那么可以使用一条多寄存器传送指令来恢复用户寄存器并实现返回。
SUBLR,LR,#4;计算返回地址STMFDSP!
R0-R3,LR;保存使用到的寄存器.LDMFDSP!
R0-R3,PC;中断返回,中断处理代码的开始部分和退出部分,如果异常处理程序已经把返回地址拷贝到堆栈,那么可以使用一条多寄存器传送指令来恢复用户寄存器并实现返回。
中断处理代码的开始部分和退出部分,2.9异常,异常的入口和出口处理,SUBLR,LR,#4;计算返回地址STMFDSP!
R0-R3,LR;保存使用到的寄存器.LDMFDSP!
R0-R3,PC;中断返回,注意:
中断
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