Whats New in Release 152.docx
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Whats New in Release 152.docx
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WhatsNewinRelease152
AllegroPCBEditor:
what’snewinrelease15.2
2003年12月份,Cadence公司发布了板级设计工具的15.2版本,这个版本中包含两个系列,一个是200系列,一个是600系列。
为了提高整个系统设计流程中的协作能力,Cadence公司在新版本中发布了新的Allegro系统互联设计平台,对其中的PCB设计和封装设计软件进行了大量的修改。
下表罗列出以前平台中产品名称和新版本中产品名称的对应关系。
Pre-PlatformName
AllegroPlatformName
Allegro
AllegroPCBEditor
AllegroPerformanceoption
AllegroPCBPerformanceoption220
AllegroViewer
AllegroPhysicalViewer610
ConstraintManager
AllegroConstraintManager
PCBDesignExpert
AllegroPCBDesign600Series
PCBDesignExpertw/Capture
AllegroPCBDesignCIS610
PCBDesignExpertw/Concept
AllegroPCBDesignHDL610
PCBDesignStudio
AllegroPCBDesign200Series
PCBDesignStudiow/Capture
AllegroPCBDesignCIS220
PCBDesignStudiow/Concept
AllegroPCBDesignHDL220
PCBDesignerSuitew/Capture
NotpartoftheAllegroplatform–contact CadenceSalesformoreinformation
PCBDesignerSuitew/Concept
AllegroPCB-legacy
AllegroDesigner-legacy
AllegroExpert-legacy
下面的表格罗列出PCB应用文档的名称变化的对应关系:
Pre-PlatformTitle
AllegroPlatformTitle
Allegro/APDUserGuide:
GettingStarted
AllegroPCBandPackageUserGuide:
StartedwithPhysicalDesign
Allegro/APDUserGuide:
DefiningandDevelopingLibraries
AllegroPCBandPackageUserGuide:
DefiningandDevelopingLibraries
Allegro/APDUserGuide:
TransferringLogicDesignData
AllegroPCBandPackageUserGuide:
TransferringLogicDesignData
Allegro/APDUserGuide:
LayoutPreparation
AllegroPCBandPackageUserGuide:
PreparingtheLayout
Allegro/APDUserGuide:
DesignRules
AllegroPCBandPackageUserGuide:
CreatingDesignRules
Allegro/APDUserGuide:
Placement
AllegroPCBandPackageUserGuide:
PlacingtheElements
Allegro/APDUserGuide:
Routing
AllegroPCBandPackageUserGuide:
RoutingtheDesign
Allegro/APDUserGuide:
DesignCompletion
AllegroPCBandPackageUserGuide:
CompletingtheDesign
Allegro/APDUserGuide:
Manufacturing
AllegroPCBandPackageUserGuide:
PreparingManufacturingData
Allegro/APDUserGuide:
APD-SpecificInformation
AllegroPCBandPackageUserGuide:
UsingPackageDesigner
AllegroSKILLReferenceManual
AllegroPCBandPackageUserGuide:
SKILLReference
Allegro:
What’sNewinRelease15.1
AllegroPCBEditor:
What’sNewinRelease15.2
AllegroKnownProblemsandSolutions
AllegroPCBEditor
KnownProblemsandSolutions
IntroductiontoAllegroTutorial
AllegroPCBEditorTutorial
UsingSPECCTRAwithAllegroTutorial
AutoroutingwiththeAllegroPCBEditor Tutorial
BestPractices:
WorkingwithIDF
NoChange
BestPractices:
WorkingwithShapes
PCBandICPackagingPhysical
Layout CommandReference
AllegroPCBandPackagePhysicalLayout CommandReference
PCBDesignStudioTutorial
AllegroPCBDesignHDL220Tutorial
GettingStartedwithPCBDesign
StudiowithConceptHDL
GettingStartedwithAllegroPCBDesign HDL220
MigrationGuideforPCBandIC
PackagingtoRelease15.0and15.1
MigrationGuideforAllegroPlatform
ProductsRelease15.0,15.1and15.2
PCBandICPackagingProperties
Reference
AllegroPlatformPropertiesReference
PCBandICPackaging
Documentation Roadmap
AllegroPlatformDocumentationRoadmap
15.2新版本总的来说在以下四个方面有显著的改进,下面分别对其进行说明。
一、提高了电气DRC检查的精确程度
这一部分包括一下几点改进之处:
时序路径中考虑了过孔和通孔管脚的Z轴方向延迟(只适用于600系列)
计算时序路径DRC错误时加入了过孔和通孔管脚的Z轴方向尺寸。
利用菜单命令Setup→Constraints→Electrical来启动DRC选项。
选中ElectricalConstraints对话框中的Options标签栏并启动其中的Z轴延迟项。
Z轴方向的延迟具有以下几点属性:
●这些DRC选项只适用于Min/MaxPropagation,RelativePropagation或者DiffPairPhaseControl等属性的电气规则
●应用规则时实际长度已经包括了过孔的导线长度
●在计算Z轴方向的长度时导线层包括的所有铜层和介质层厚度
●计算Z轴方向的长度时不包括导线开始的铜层以及导线结束的铜层。
例如,10层的PCB板中用一个过孔连接了层1到层4的信号。
那么计算的过孔长度为:
VIA(ZLength)=L2+L3+D1+D2+D3 其中,L代表布线层D代表介质层。
管脚延迟特性从以前的外部时序路径中放在封装中考虑(只适用于600系列)
15.2以前的版本中,系统级的约束需要创建一个DesignLink然后再处理相关的单板或者封装数据。
从一个芯片的Die点到另一个Die点之间的时序路径需要用CadenceAPD工具中的.mcm文件来创建路径。
但是我们不能经常从芯片供应商处获得相关的数据,最常用的变通办法就是在别的应用程序诸如Excel中用计算公式来计算。
15.2版本中有一个新的属性PIN_DELAY可以通过Cadence工具(包括PartDeveloper)接受外部的延迟数据(如封装长度等)。
这些数据可以读入PCBEditor中然后根据一个.csv文件分配给一个元器件,就好像给管脚分配属性或者值一样。
也可以在约束管理器中PropagationDelay或者DiffPair工作页面中的PIN_DELAY项输入值。
和激活Z轴方向延迟一样我们可以选择菜单命令Setup→Constraints→Electrical,选择Options标签栏然后激活PinDelayDRC选项!
当使用约束管理器时,选择菜单命令Analyze-AnalyzeModes再选择Options标签,分配给他的相应的值就会出现在相关的工作页中。
值的对应关系和管脚对中的管脚顺序是一一对应的。
例如,分配给器件U2的管脚T2的管脚延迟是602mils。
这个值出现在管脚延迟的“PIN1”处,这是因为管脚对的定义顺序为U2.T2:
J42.75。
可以根据不同层设置不同的差分对Primary/NeckGap属性(适用于200和600系列)
15.0版本限制将差分对信号设置为一个独立的主间距解决方案。
可以用工作区来使应用多种电气约束的差分对满足不同层的要求。
其中Neckgap也是一种可选方案。
15.2版本中可以用菜单命令Setup→Constrains→PhydicalRuleSet→SetValue给差分对信号根据不同层的要求定制不同的差分间距要求。
这和15.0以及15.1中设置主线宽和副线宽的模式是一样的。
DRC检查时首先查看电气约束的值,如果不满足,就查看物理规则集中的间距宽度。
Cadence公司提出如下两点建议:
●如果差分对信号的线宽和间距除了管脚引出处不同外在整个布线路径上是保持不变的,可以应用电气规则集给差分对信号设置所有的物理参数。
●如果差分对信号在不同的层有不同的线宽和间距要求,将电气规则集中的物理参数部分设置为空白,然后在物理规则集中设置线宽和间距。
可以设置多个匹配的或者嵌套的组(适用于200和600系列)
源同步总线信号要求所有的网络、管脚对都在一下相互匹配的组里面。
15.2以前的版本中,PCBEditor要求一个管脚对只能在一个匹配组里。
15.2版本去除了这种限制。
网络和管脚对可以在一个或者多个匹配的组里。
交互式的布线反馈信息显示出在处理多个条件要求时出现最坏的情况。
当用15.0版本的工具打开一个设计文件时,PCBEditor会去除这些多重匹配组的属性。
二、提高了手动的布线编辑能力
这一部分包括一下几点改进之处:
在04年2月的15.1ISR版本中增加了手工的延迟调整能力(InteractiveDelayTuning)(适用于200和600系列)
从15.1ISR版本开始200系列和600系列的产品开始有手工的延迟调整能力。
可以选择不同的匹配方式如折叠线、弯曲线和锯齿线等来实现这种新的功能。
用户可以选择控制不同的间距和幅度。
调整点是设计者可以完全控制的,只要最后能满足整体的延迟和匹配约束。
PCBEditor可以任意的选择准确的调整区域以及调整点。
光标的位置就能精确的反映出在哪里调整以及调整的余量(幅度值的一半)是多少。
实时约束显示可以提供直接的反馈信息。
下图是其命令图标,右图是执行命令后控制面板中Options标签栏的设置选项。
排线的布线方式(适用于200和600系列,600系列中还包括一些高级功能)
15.2新版本增加了排线的布线能力。
用鼠标框选一组被选对象,可以是走线、过孔或者管脚,然后开始同时布线。
在600系列中,点击鼠标右键,从弹出菜单中选择User-defined或者minimumDRC可以将现有的线到线的间距改变。
另外还新增加了一些功能,如将受控走线从最初的起点改变到用户设定的起点;将单根布线改为完整布线的状态。
在04年2月的15.1ISR版本中增加了推挤的功能
推挤命令提供了45度角的延长线布线方式。
在以前的版本中,要应用这种功能必需在TempGroup或者别的工作区的配合下实现。
为了得到最好的效能,在延长线方式时将max45-degreelength和miterlength的值设置成一样,同时禁止Bubble和Smooth选项也有助于提高推挤命令的功效。
三、生产制作方面的改进(UpdateofManufacturingApplications)
这一部分包括以下几点改进之处:
SlotsasDatabaseObjects
现在焊盘编辑器中可以使用槽形孔了,它是数据库的一种对象。
可以选择长方形的或者椭圆形的槽,槽的形状以及X向和Y向的尺寸都和槽的实际大小成比例。
在BRD文件中可以执行菜单命令Tools→Reports来产生一个CSV/HTML格式的报表,详细罗列出槽的种类、位置以及旋转角度。
如果执行了NCRoute命令,则该命令检查板上所有的槽并将相关信息记录到
DrillTolerance
15.2新版本中增加了金属化和非金属化的槽形孔和圆孔的正负钻孔误差容量。
这些钻孔误差可以在设计焊盘时输入,也可以在钻孔定制表中添加或修改。
钻孔误差信息保存在.drl文件中。
格式如下图所示。
;FILE:
ncdrill-1-10forlayersTOPandBOTTOM
;T01Holesize1.=12.000Tolerance=+1.000/-12.000PLATEDMILS
;T02Holesize2.=22.000Tolerance=+2.000/-3.000PLATEDMILS
;T03Holesize3.=32.000Tolerance=+1.000/-1.000PLATEDMILS
SameDrillwithDifferentToleranceRequirements
Ncdrill和Nclegend命令在输出ncdrill和nctape数据的时候,对相同孔径尺寸和金属化信息但有不同孔径误差的焊盘分别输出。
例如,design.drl文件对40mil的孔径但有两种孔径误差的输出格式如下:
;FILE:
ncdrill-1-10forlayersTOPandBOTTOM
;T01Holesize1.=12.000Tolerance=+1.000/-12.000PLATEDMILS
;T02Holesize2.=40.000Tolerance=+2.000/-3.000PLATEDMILS
;T03Holesize3.=40.000Tolerance=+1.000/-1.000PLATEDMILS
DrillCharacterField
钻孔和槽的字符由原来的一位提高到3位。
Non-StandardDrillCharacterization
圆孔的非标准化参数包括Laser,Plasm,Punch或者其他参数。
相对与别的标准化参数,这些非标准化参数被单独记录在一个dil文件,这使得制造者在处理输入数据时非常容易。
IncreasedFlexibilitywithMultipleDrills
PadstackDesigner中的多钻孔部分现在新增加了Staggered选项,这样X方向和Y方向的间距可以设置为不同的值。
UpdatingtheUserInterfaceandCommands
用户界面现在已经升级到通用的用户界面标准。
现在的主菜单命令Manufacture-NC中包含了以下的子菜单和相应的控制命令。
MenuCommand
ConsoleCommand
Statue
DrillCustomization
ncdrillcustomization
New
DrillLegend
ncdrilllegend
Nochange
NCParameters
ncdrillparam
formerlyDrillParameters
NCDrill
nctape_full
formerlyDrillTape
NCRoute
ncroute
formerlyRoute
●NCDrill现在产生的缺省文件名为
如果还想继续应用ncdrill.tap的文件名,可以编辑修改nc_param.txt文件。
●在NCROUTE对话框中,缺省的文件名字符已经修改为
当单独执行ncroute命令时,这种改变也是适用的。
●在PCBEditor中执行NCDrill或者NCROUTE命令时,正确的绘图名会出现在相应的日志文件中。
而以前,PCBEditor是用一种含义模糊的文件名来暂时的保存设计,这种方法可以方便用批命令的方式访问。
●NCDRILL对话框中已经取消了PatternforDIPs和tape相关的菜单。
旧的参数文件中产生的告警信息是过时的、可忽略的,是新的参数文件没有没有涉及到的。
各种相关的信息以及日志文件都已经被修改了。
磁带参数也被取消了。
●在15.2新版本以前,如果系统中没有找到合适的缺省模板文件.dlt,DrillLegend命令就会终止运行。
但现在的处理方式是,它会发出一个告警信息,然后继续所有的处理,但在输出文件中的留出空的drilllegend模板文件。
EnhancedNCParameterDialogBox
NCParameter的对话框有以下一些改进:
●文件头部分现在已经可以支持1024个字符了,还可以支持多文件头的记录。
●增加了EnhancedExcellonFormat
●对于ncdrill和ncroute来说,这部分的设置是完全通用的。
●对于ncdrill和ncroute来说不同的设置已经转移到专门的输出文件中了。
DrillOutput-AutoToolSelect
应用了自动工具选项后就不再需要nc_drill.txt文件在钻孔文件中插入工具代码了。
如果找不到工具文件,Viewlog中就会生成一个告警信息,它表面工具文件是自动生成的。
生成钻孔文件时自动选择是首选的方法。
下面就是一个包括新的容差信息和扩展的文件头的示例:
;T01Holesize1.=12.000000Tolerance=+1.000000/-2.000000PLATEDMILS
;T02Holesize2.=22.000000Tolerance=+1.000000/-2.000000PLATEDMILS
;T03Holesize3.=55.000000Tolerance=+1.000000/-2.000000PLATEDMILS
;T04Holesize4.=68.000000Tolerance=+1.000000/-2.000000NON_PLATEDMILS
G90
T01
X03225Y02125
T02
X00645Y02081
T03
X00311Y-00025
T04
X00208Y-00213
M30
EnhancedExcellonFormat
在文件头部分给“T
“T
例如:
M48
INCH
T01C.01
;T01Holesize1.=10.000000Tolerance=+1.000000/-2.000000PLATEDMILS
RedirectingArtwork/DrillFilestoaSpecificDirectory
15.2版本中可以定义一个指定的路径名作为PCBEditor的工作路径,这样光绘文件和数控文件就可以在这个文件目录中读写了。
选择菜单命令Setup→UserPreferences→FileManagement然后设置参数ads_sdart即可。
AutomaticCreationofLegendsonBlind/BuriedViaBoards
15.2版本中可以一个步骤就生成盲埋孔的钻孔图例。
选择菜单命令Manaufacture→NCDrill→Legend可以同时放置钻孔图例并生成相应的NCLEGEND子类。
现在的NCLEGEND子类是以前的NCDRILL_LEGEND和NCDRILL_FIGURE子类的合集,在数据库中被认为是一个整体。
后续命令执行后放置位置仍然保持不变。
LegendDataJustification(图例数据调整)
新的图例缺省文件模板.dlt包括了图例表名称栏的层命名,并扩展了SIZE和TOLERANCE两列用来分别设置槽孔和孔径冗余误差。
另一个改进之处就是允许钻孔图例表中各项数据分别进行调整。
注意:
调整不影响列的头,只影响数据。
钻孔图例模板文件.dlt中?
ColumnDefinitions中的实体
下面为系统缺省路径share\pab\text\nvlegens下面模板文件.dlt的示例:
;Eachcolumndefinitionbelowcanhaveanoptional4thfield
;includedtocontrolthejustificationofthedatadisplayed
;withinthatcolumn.Thepermittedvaluesareofcourse:
;
;"center","right",or"left";
;with"center"beingthedefaultifthe4thfieldisnotprovided,
;
- 配套讲稿:
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