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PCIE硬件测试方法
PCI-Express硬件测试方法
图目录
1PCI-E物理层概述
物理层的基本连接构成是两对低压差分信号:
一对用于接收,另一对用于发送。
数据以8bit/10bit编码单向传送速率可达2.5Gbps,时钟信号内嵌入数据流。
物理层将物理层数据包从一个PCIExpress器件的数据链路层传到另一PCIExpress器件的数据链路层。
图1Express物理层通道结构
物理层由两个子部分组成,分为逻辑子块和电气子块,如下图所示:
图2物理层的逻辑和电气子部分
逻辑子块和电气子块通过一个控制和状态寄存器,或者类似功能的单元进行接口,实现每个发送端状态的协调。
逻辑子块直接控制和管理物理层的功能。
逻辑子块包含发送和接收2个部分,主要功能包括:
重启、链路初始化、配置(速率、链路带宽、通道映射、Lane之间的de-skew等)、数据编码/解码(8B/10B)、数据扰码等。
图3物理层逻辑子部分“链接训练状态逻辑状态机”
电气子块包括一个发送端和一个接收端,主要功能包括包转换、电源管理、热插拔等。
PCIExpress规范电气子块部分对通道的串行收发差分对的时钟精度、终端匹配、直流共模电压、ESD、短路、接收端检测、电气空闲状态定义和识别、发送和接收信号的指标、抖动、损耗、信号眼图指标等都进行了详细和明确的定义,以下章节详细描述。
2PCI-E电气子块(Ver1.0)
2.1电气子块规则
2.1.1规则:
时钟
判据1:
扩频信号频率为2.5GHz额定频率的+0%~-0.5%内(考虑SSC带来的偏差);
判据2:
调制信号频率为30kHz~33kHz;
判据3:
时钟精度为+/-300ppm、链路两端设备间时钟精度不超过600ppm(包括SSC和非SSC两种模式);
备注:
一般使用SSC调制时链路两端设备时钟频率相同。
2.1.2规则:
AC耦合
判据1:
75nF≤发送端AC耦合电容≤200nF;
2.1.3规则:
互连
判据1:
包括测试仪器探头等效电容在内,互连线对地总电容最大3nF;
2.1.4规则:
终端匹配
判据1:
传输差分信号时发送端差分输出阻抗ZTX-DIFF-DC:
最小80Ω、最大120Ω、典型值100Ω;发送端输出阻抗ZTX-DC最小40Ω;
判据2:
差分信号空闲时发送端输出阻抗ZTX-DC最小40Ω;
判据3:
接收端差分输入阻抗ZRX-DIFF-DC:
最小80Ω、最大120Ω、典型值100Ω;输入阻抗ZRX-DC:
最小40Ω、最大60Ω、典型值50Ω;
判据4:
设备掉电、重启或检测时:
接收端输入阻抗ZRX-HIGH-IMP-DC最小200kΩ;
2.1.5规则:
DC共模电压
判据1:
接收端共模电压为0V+/-10mV;
判据2:
发送端共模电压小于3.6V;
2.1.6规则:
ESD
判据1:
所有信号和电源能忍受2000VESD(humanbodymodel);
判据2:
或者所有信号和电源能忍受500VESD(chargeddevicemodelwithoutdamage);
判据3:
满足JEDECJESE22-A114-AClass2标准;
2.1.7规则:
短路
判据1:
所有发送端和接收端支持热插拔,且不损坏设备;
判据2:
发送端和接收端D+和D-能长时间对地短路;
判据3:
发送端短路电流ITX-SHORT最大值90mA;
2.1.8规则:
接收检测
备注:
接收检测电路检测输入阻抗ZRX-DC步骤如下:
1、检测开始前保证发送端稳定电压到VDD或者GND,或者VDD与GND间的一个固定电平;
2、发送端转变D+和D-共模电压:
将共模电压从VDD转变为GND;或将共模电压从GND转变为VDD;或将共模电压从VDD与GND间的固定电平转变为相对反电压;
3、判断有无接收端基于电压转换的速率:
如果检测出快速的转变沿,则表示接收端未连接;如果检测出慢速的转变沿,则表示存在发送端阻抗、互连线容抗、一系列电容和接收端终端匹配,即接收端已连接;
图4接收端检测原理
图5接收端检测结果
2.1.9规则:
电气空闲态
发送端D+和D-电压保持相同恒定值时为电气空闲状态,主要用于省电模式和非使能态。
判据1:
跳出电气空闲态门限电压VRX-IDLE-DET-DIFFp-p最小65mV,最大175mV;
2.2电气信号规则
2.2.1规则:
信号定义
定义差分电压:
VDIFF=VD+-VD-
定义共模电压:
VCM=[VD++VD-]/2
定义差分电压峰峰值(差分摆幅对称时):
VDIFFp-p=2*max|VD+-VD-|
定义差分电压峰峰值(差分摆幅不对称时):
VDIFFp-p=max|VD+-VD-|{VD+>VD-}+max|VD+-VD-|{VD+ 定义差分峰值电压(差分摆幅对称时): VDIFFp=max|VD+-VD-| 定义差分峰值电压(差分摆幅不对称时): VDIFFp=max|VD+-VD-|{VD+>VD-}ormax|VD+-VD-|{VD+ 定义共模峰值电压: VCMp=max|VD++VD-|/2 2.2.2规则: 损耗 判据1: 使用眼图来测量差分电压衰减幅度,眼图要求如后所述; 备注: 根据衰减量来定量互连线损耗能够指明发送端和接收端之间的衰减容限,譬如1.25GHz速率数据的最坏情况下损耗裕量可以用发送最小输出电压VTX-DIFFp-p=800mV和接收最小输入电压VRX-DIFFp-p=175mV来计算,最大损耗为: 20log(175/800)=-13.2dB;625MHz速率数据的最坏情况下损耗裕量可以用发送最小去加重输出电压VTX-DIFFp-p=505mV和接收最小输入电压VRX-DIFFp-p=175mV来计算,最大损耗为: 20log(175/505)=-9.2dB; 2.2.3规则: 抖动Jitter和误码率BER 抖动可分类为随机抖动Rj和确定性抖动Dj,总抖动Tj是所有无关抖动源的概率密度卷积,而随机抖动Rj呈高斯分布,常被用来确定链路比特误码率BER。 满足BER为10-12时的最大Tj; 2.2.4规则: 去加重De-emphasis 判据1: 跳变位差分电压峰峰值VTX-DIFFp-p最小0.8V,最大1.2V; 判据2: 非跳变位差分电压可小于跳变位3.5dB(+/-0.5dB); 图6去加重采样波形 2.2.5规则: Beacon唤醒信号 判据1: 周期直流平衡数据信号Beacon要求: 2ns<=脉宽<=16us; 判据2: 平衡对称信号最大恢复时间32us; 判据3: 当脉宽超过500ns时电压幅度去加重-6dB; 判据4: 当脉宽小于500ns时电压幅度去加重-3.5dB; 图730kHzBeacon采样波形(周期33us) 图8500MHzBeacon采样波形(周期2ns) 2.3发送端眼图模板 判据1: 大小两个不同的发送端眼图定义跳变位和非跳变位(即去加重位)的区别; 判据2: 采集超过3500个连续UIs中选择250个有效稳定的UIs来计算和创建眼图; 备注: 测试时保证负载串联75nF~200nF交流耦合电容和50Ω单端/100Ω差分端接电阻,可参考2.5节无源测试负载; 图9近端(发送端)眼图模板 2.4接收端眼图模板 判据1: 采集超过3500个连续UIs中选择250个有效稳定的UIs来计算和创建眼图; 备注: 测试时保证负载串联75nF~200nF交流耦合电容和50Ω单端/100Ω差分端接电阻,可参考2.5节无源测试负载; 图10远端(接收端)眼图模板 2.5一致性测试负载 备注: 眼图和电气测试时保证负载串联75nF~200nF交流耦合电容和50Ω单端/100Ω差分端接电阻,如厂商未指定测试点,可选择D+和D-输出管脚(小于0.2英寸); 图11一致性测试负载 3PHY电气测试项目 PHYElectricalTestConsiderationsRevision1.0规范推荐测试项目,其中黑色字体代表重点测试项目。 3.1通用测试项目 编号 测试项目描述 用例编号 PHY.3.1#1 发送端和接收端的时钟精度+/-300ppm 测试1.1 PHY.3.1#2 使用SSC,扩频信号频率为2.5GHz额定频率的+0%~-0.5%(考虑SSC带来的偏差) 测试1.2 PHY.3.1#3 使用SSC,调制信号频率范围为30kHz~33kHz 测试1.2 PHY.3.1#4 互连通信端口间扩频信号频率精度不超过600ppm(包括SSC和非SSC两种模式) 测试1.3 3.2发送端测试项目 编号 测试项目描述 用例编号 PHY.3.1#12 TXDC共模电压(Vtx-dc-cm)范围为0~3.6V(+/-100mV) 测试1.6 PHY.3.1#14 在接收端检测时电压变化不能超过600mV(Vtx-rcv-detect) 测试1.8 PHY.3.1#17 高阻抗临界值Zrx-high-imp-dcMin(3nF容抗,输入阻抗200kΩ),检测出接收端未连接 测试1.9 PHY.3.1#18 低阻抗临界值Zrx-com-dcMin(交流耦合电容75nF,输入阻抗40Ω),检测出接收端已连接 测试1.10 PHY.3.1#19 从电气空闲态转到发送差分信号后发送端满足眼图模板 测试1.16 PHY.3.1#23 进入电气空闲态前发送端须发送电气空闲命令,即三个K28.3(IDL)后跟随一个K28.5(COM) 测试1.7 PHY.3.1#24 发送端发送完最后一个电气空闲态命令,通过20UI时间后进入电气空闲有效状态,即通过8ns(Ttx-idle-set-to-idle)时间来满足电气空闲电压要求 测试1.7 PHY.3.1#26 进入或者退出电气空闲态时发送端满足DC共模电压规范: 数据线间保持≤25mVDCCM(Vtx-cm-dc-line-delta);L0态和电气空闲态转变间保持≤100mVDCCM(Vtx-cm-dc-active-idle-delta) 测试1.6 PHY.3.1#27 进入电气空闲态后发送端保持最小50UI(Ttx-idle-min)时间,该20ns时间可供接收端响应退出命令 测试1.7 PHY.3.1#30 进入共模模式检测前发送端在VDD~GND间保持稳定值 测试1.17 PHY.3.1#31 接收端检测时,D+和D-共模电压可从VDD转变为GND 测试1.17 PHY.3.1#32 接收端检测时,D+和D-共模电压可从GND转变为VDD 测试1.17 PHY.3.1#33 接收端检测时,D+和D-共模电压可从VDD和GND之间转变为相对反电压 测试1.17 PHY.3.2#1 连续发送相同电平数据时须去加重,降低跳变位差分电压3.5dB(+/-0.5dB) 测试1.5 PHY.3.2#2 差分信号满足0.8~1.2VDIFFp-p(Vtx-diffp-p)差分电压峰峰值要求(Beacon信号除外) 测试1.5 PHY.3.2#3 通用PCIExpress设备支持远程唤醒机制,需要支持Beacon信号,其他情况Beacon可选 测试1.18 PHY.3.2#4 在多通道连接(×n)时通道0须发送和接收Beacon信号 测试1.18 PHY.3.2#5 Beacon信号是周期任意的DC平衡数据信号,2ns<=脉宽<=16us 测试1.18 PHY.3.2#6 Beacon信号是DC平衡数据信号,对称信号最大恢复时间32us 测试1.18 PHY.3.2#7 Beacon脉冲脉宽超过500ns时,电压幅度去加重-6dB 测试1.18 PHY.3.2#8 Beacon脉冲脉宽小于500ns时,电压幅度去加重–3.5dB 测试1.18 PHY.3.2#9 当桥片在下行口接收到Beacon信号或者远程唤醒命令时,该设备须将该信号往上行口传递 测试1.29 PHY.3.2#11 Beacon信号脉宽为2ns~16us 测试1.18 PHY.3.2#13 通用PCIExpress设备支持远程唤醒机制,需要支持Wake#信号,其他情况Wake#可选 测试1.18 PHY.3.2#14 低功耗应用环境下减小差分输出电压最小值会增加最坏互连情况下的损耗值,须关闭发送端去加重功能才能满足发送端眼图模板 测试1.5 PHY.3.2#15 当桥片在下行口接收到唤醒命令时,该设备须将信号往上行口传递 测试1.30 PHY.3.3#1 所有PCIExpress设备满足发送端眼图,连接测试负载后在封装的管脚处测量,眼图数量至少250个连续UIs 测试1.5 PHY.3.3#2 未使用SSC,每个UI精度满足400ps+/-0.03%(即+/-300ppm) 测试1.4 PHY.3.3#3 在发送端封装管脚处测量到的最小D+和D-20%~80%输出上升下降时间≥50ps 测试1.12 PHY.3.3#4 发送端抖动(Ttx-eye-medianto-max-jitter)最大60ps 测试1.5 PHY.3.3#5 连接测试负载后在发送端封装管脚处测量到可允许的最大RMSAC(>30Khz)共模电压为20mV(Vtx-cm-acp) 测试1.13 PHY.3.3#6 连接测试负载后在发送端封装管脚处测量到电气空闲差分峰值输出电压(Vtx-idle-diffp)≤20mV 测试1.15 PHY.3.3#7 在接收端检测到信号幅度大于Vrx-idle-det-diffpp(65mV)时退出电气空闲状态 测试1.19 PHY.3.3#8 通道间输出偏斜≤1300ps(500ps+2UI),对于单链接来说此为任意两条发送端通道间的静态偏斜 测试1.11 PHY.3.3#9 连接测试负载后在发送端封装管脚处测量到最小TX眼宽(Ttx-eye)为280ps 测试1.5 3.3接收端测试项目 编号 测试项目描述 用例编号 PHY.3.1#10 当接收数据时(LTSSM所有状态),接收端差分阻抗为80~120Ω(Zrx-diff-dc) 测试1.20 PHY.3.1#11 接收端DC共模电压为0V+/-10mV 测试1.14 PHY.3.4#1 接收端满足最小接收眼图和电压一致性规范;测试时采用一致性测试负载代替RX设备管脚;设计时须给封装和器件对RX信号质量带来的影响留有裕量 测试1.21 PHY.3.4#2 当AC峰值共模电压小于150mV(Vrx-cm-acp)时,接收端须可靠接收数据 测试1.21 PHY.3.4#3 接收端能检测出意外电气空闲状态发生: 在接收端管脚处测量到持续时间超过10ms的差分峰峰值电压跌落值小于65mV(Vrx-idle-det-dffp-pmin) 测试1.22 PHY.3.4#6 接收端可靠接收数据的抖动(Ttx-eye-medianto-max-jitter)最大120ps 测试1.21 PHY.3.4#9 通道间偏斜(Lrx-skew)不超过20ns时接收端能可靠接收和汇集数据;包括SKP指令设置RX的偏斜量和互连线本身带来的偏斜量 测试1.23 3.4母板测试项目 编号 测试项目描述 用例编号 EM.4#4 如果平台唤醒功能使能则可向PCIExpress插卡连接器提供+3.3Vaux电压和每个连接器375mA电流 测试1.24 EM.4#5 如果平台唤醒功能非使能(不支持WAKE#信号)则可向PCIExpress插卡连接器提供+3.3Vaux电压和每个连接器20mA电流 测试1.25 EM.4#7 PCIExpress连接器的电源分配满足PCIExpress插卡机电规范(PCIExpressCardElectromechanicalSpecification表4-1);母板设计与75W电源ECN一致,满足额外的电源需求 测试1.26 EM.4#14 母板按照要求最小化抖动值(PCIExpressCardElectromechanicalSpecification4.6.3节表4-4要求) 测试1.5 EM.4#16 母板按照要求最小化通道间偏斜,最大1.25ns(PCIExpressCardElectromechanicalSpecification4.6.5节表4-5要求) 测试1.9 EM.4#20 在连接器后真实负载处测试,母板满足发送端眼图模板要求(PCIExpressCardElectromechanicalSpecification4.7.3节表4-8要求) 测试1.5 EM.4#22 母板接收端满足接收端灵敏度要求(PCIExpressCardElectromechanicalSpecification4.7.4节表4-9要求) 测试1.21 3.5插卡测试项目 编号 测试项目描述 用例编号 EM.2#27 每个设备能进入“初始激活链接训练态”(退出电气空闲态),持续80ms,以PERST#有效来结束 测试1.27 EM.4#13 母板按照要求最小化抖动值(PCIExpressCardElectromechanicalSpecification4.6.3节表4-4要求) 测试1.5 EM.4#15 母板按照要求最小化通道间偏斜,最大0.35ns(PCIExpressCardElectromechanicalSpecification4.6.5节表4-5要求) 测试1.5 EM.4#19 金手指处,插卡满足插卡发送端眼图模板要求(PCIExpressCardElectromechanicalSpecification4.7.1节表4-6要求) 测试1.5 EM.4#21 插卡接收端满足接收端灵敏度要求(PCIExpressCardElectromechanicalSpecification4.7.2节表4-7要求) 测试1.21 EM.4#23 插卡功耗满足最大功耗要求(PCIExpressCardElectromechanicalSpecification4.2节表4-2要求) 测试1.31 EM.6#4 一个×8插卡可兼容作为×4卡插卡使用 测试1.28 4TEK测试方案简介 4.1两个SMA通道连接 通过设置示波器数学运算功能CH1-CH3得到差分信号,通过(CH1+CH3)/2得到共模信号;50Ω单端匹配电阻在示波器内部端接; 图12两个SMA通道连接 4.2一个带SMA输入差分探头P7350SMA测试 高速差分SMA输入探头P7350SMA在探头中集成双50Ω端子网络和差分放大器来测量差分信号对; 图13一个带SMA输入差分探头P7350SMA测试 4.3两个单端有源探头P7260测试 通过设置示波器数学运算功能CH1-CH3得到差分信号,通过(CH1+CH3)/2得到共模信号;可测试线路实际码流,探头尽量缩短地线长度,并靠近端接电阻处。 图14两个单端有源探头P7260测试 4.4一个差分探头P73xx测试 可测试线路实际码流,探头靠近端接电阻处。 图15一个差分探头P73xx测试 5PHY电气测试用例 5.1符合性_PCI-E时钟精度测试 用例名称 符合性_PCI-E时钟精度测试 测试目的 测试正常通信时时钟精度差,适用于链路两端使用自身的源时钟信号(包括扩频时钟SSC应用) 测试设计 无 测试组网图 无 测试步骤 1、使用频率计测量发送端时钟源频率; 2、使用频率计测量接收端时钟源频率; 3、比较两个时钟频率精度差(包含使用SSC和非SSC两种模式); 4、也可使用实时示波器来同步捕获两者时钟,使用示波器分析软件来计算和比较每个时钟的频率; 预期结果 SSC和非SSC两种模式下时钟频率精度保持在600ppm之内; 测试说明 无 5.2符合性_SSC扩频时钟测试 用例名称 符合性_SSC扩频时钟符合性测试 测试目的 检测扩频时钟的低频调制信号是否满足接收端解调的上下限 测试设计 无 测试组网图 测试环境建立有两种方式: 方式1(推荐): 采用50Ω同轴电缆将信号直接引入示波器 同轴电缆的带宽可达到10G以上,对信号中的高频部分的衰减很小,测试结果最为真实; 方式2: 示波器的高速探头 用高带宽探头差分或2个单端探头点击在最靠近接收芯片的测试点上即可测试信号。 目前TEKDPO、AgilentDSO、LeCroyWavePro等都有各自的抖动测试软件,但对扩频时钟的测量对示波器硬件要求很高,尤其是内存,在测试时可根据需要选择合适的测试工具。 测试步骤 1、测试环境建立后,引入测试信号(实时采样); 2、打开示波器的抖动测试软件(TEKJIT3、AgilentEZJIT或者相应测试应用软件); 3、设置足够的存储深度,一般调制时钟的频率都相对较低,要分辨调制波形至少需要测试其两个周期以上的波形。 (推荐存储深度16M以上,对测试仪器要求很高) 4、选择抖动测量项为TIE,并使能该项绘图功能,用来显示是否还有其他抖动成分存在; 5、选择抖动的时间趋势图测试,实行TIE的时间趋势测量,并使能该项绘图功能。 根据测试需要可能需要选择适当的滤波功能,使某些频段的抖动趋势更加明显。 该项测试可考察调制信号波形是否合格; 6、选择抖动的频谱图测试,实行TIE的频谱测量,并使能该项绘图功能。 该项测试可考察调制信号频率是否合格; 7、一般选择单次触发减少由于示波器触发抖动引起的测量误差; 8、开始测量; 预期结果 1、数据速率为2.5Gb/s+300ppm/-5300ppm(该数据速率包含SSC带来的偏差): 上限频率为: 2.50075Gb/s=NominalUI+300ppm;下限频率为: 2.48675Gb/s=NominalUI–5000ppm(SSCBudget)–300ppm;即400.12397.88ps 2、SSC调制信号频率为30-33kHz.; 3、下面给出一个实际测试得到的扩频时钟的调制波形供参考 测试说明 5.3符合性_PCI-E一致性测试 用例名称 符合性_PCI-E一致性测试 测试目的 PCI-E一致性测试项目包括: 发送端(数据单位间隔UI、差分输出电压峰峰值、去加重差分输出电压比例、发射眼图宽度、抖动分布中值与最大值之时间差、输出上升/下降时间、AC共模输出电压峰值、发送端差分回波损耗、DC差分发射端阻抗),接收端(数据单位间隔UI、差分输入电压峰峰值、接收眼图宽度、抖动分布中值与最大值之时间差、AC共模输入电压峰值、接收端差分回波损耗、DC差分接收端阻抗),检测信号实时波形各项参数是否满足要求。 测试设计 无 测试组网图 测试环境建立有两种方式:
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- 特殊限制:
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