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计算机硬件结构及工作原理
第5章计算机硬件结构及原理
【教学内容及地位、作用】
内容摘要
地位和作用
总线
总线的原理及三态门
计算机系统设计、组装维护、程序设计、接口设计的知识基础
总线分类及总线标准
总线缓冲器
运算器
算术逻辑运算部件(ALU)
定点运算器
存储器
存储器的分类
静态随机存储器(SRAM)
动态随机存储器(DRAM)
只读存储器
存储体系结构
存储器的层次结构
高速缓冲存储器
外存储器
虚拟存储器
控制器
控制器的工作原理
控制器的组成
指令的执行过程
控制器的控制方式
微程序控制器
8086的内部结构
【教学目标】
1.认识计算机总线、运算器、存储器、控制器等重要的计算机硬件。
2.了解常见总线(PCI、AGP等)的特点、运算器的种类和结构特征。
●能领会总线的操作过程;
●能理解单总线结构、双总线结构和三总线结构定点运算器的结构特征。
3.知道计算机的主要硬件结构及其原理。
●知道数据总线、地址总线和控制总线及总线性能指标;
●知道ALU、RAM、ROM、PROM、EPROM、EEPROM、Cache、PC、IR、AR、DR。
4.掌握存储器扩展、存储系统的层次结构、控制器的组成及工作原理。
●能进行简单存储器的扩展设计;
●能理解Cache、虚拟存储器的作用,会进行地址映像;
●能理解控制器的结构及工作原理,熟记8086CPU的内部寄存器及功能。
【教学重点、难点】
1.总线的作用及工作原理。
2.ALU及定点运算器。
3.存储器扩展及存储技术的实现。
4.8086CPU。
总线
总线原理及三态门
总线:
是计算机系统各部件(也称模块)之间传送信息的公共通道,由若干条通信线和起驱动、隔离作用的三态门组成。
总线传输的原则:
同一时刻只允许传输1个信号,否则会出现信号冲突(即信号叠加),导致信息传输错误。
总线为所连接的多个部件服务的方法是分时传输。
部件与总线的连接:
通过三态门来控制。
图5-1-1是总线与三态门的连接图。
总线连接包括两个层次:
①物理连接:
机械和电气方面的连接,是指采用什么样的电缆和连接器,总线的驱动能力和传输距离,传输线的屏蔽、接地和抗干扰技术等。
②逻辑连接:
主要解决基本信息的缓冲与锁存、总线握手和总线裁决等问题,也即总线时序和总线使用权分配的问题。
总线请求:
总线在使用时须先由具有总线申请权的主模块向总线控制器件发出请求。
主模块是指具有控制功能的模块,如CPU或DMAC(DMA控制器);受控的模块为从属模块,如存储器或I/O接口。
只有主模块才能发出使用总线请求。
微型计算机采用总线结构的优点:
采用总线结构之后,使系统中各功能部件间的相互关系转变为各部件面向总线的单一关系。
一个部件(功能板/卡)只要符合总线标准,就可以连接到采用这种总线标准的系统中,也即总线标准化使微机系统成为一个开放的体系结构。
①简化了系统结构。
②便于采用模块结构设计方法,简化了软、硬件的设计。
③便于系统的扩充和升级。
④便于故障诊断和维修,同时也降低了成本。
一、总线的操作过程
挂在总线上的各模块是通过总线进行信息交换,即数据传输的,完成一次数据传输要经历以下四个阶段。
1.总线请求和仲裁阶段
当系统总线上接有多个总线主模块时,需要使用总线的主模块向总线提出申请,由总线仲裁机构确定后,把下一个传输周期的总线使用权交给申请的主模块。
2.寻址阶段
获得总线控制权的主模块,通过地址总线发出本次打算访问的从模块的地址及有关操作命令,通过译码使被访问的从属模块被选中,从而开始启动。
3.数据传送阶段
主模块和从属模块进行数据交换。
4.结束阶段
主、从模块的有关信息均从总线上撤除,让出总线,以便其它模块继续使用。
二、总线的通信方式
总线上的主、从模块间进行数据传送称为通信。
为了保证通信的可靠性,主、从模块间至少应满足下述关系:
发送模块在开始发送数据时,接收模块应做好接收的准备。
在接收模块没有接收到准确数据前,发送模块不应撤除发送信号。
总线上的主、从模块通常采用的三种通信方式:
1.同步传输
同步传输也称为同步通信方式,是指总线上的各模块严格地在时钟控制下工作的方式,如图5-1-2所示。
特点:
要求主模块按严格的时间标准发出地址信号、产生指令,从属模块按严格的时间标准读出数据或写入数据。
2.半同步传输
半同步传输方式是对同步方式的一种改进,如图5-1-3所示。
它保留了同步传输的基本特点。
总线上的各模块基本上还是在时钟控制下统一动作,对于快速的从模块,采用同步方式;但是对于某些不能在规定时间内完成操作的慢速从模块,可以请求延长操作时间。
3.异步传输
异步传输方式也称为应答方式,如图5-1-4所示。
进行通信的主、从模块不受统一的时钟控制,而是采用“请求”和“应答”信号来协调传输过程。
三、总线的主要技术参数
1.总线带宽
总线带宽是衡量总线传输速度的重要指标,是指单位时间内总线上可传送的数据量,一般用每秒钟传送的字节数来表示,单位为MBps。
2.总线位宽
总线位宽是指总线能同时传送的数据位数,即总线宽度,如16位、32位、64位等。
在工作频率一定的条件下,总线的带宽与总线的位宽成正比。
3.总线的工作频率
总线的工作频率也称为总线的时钟频率,单位为MHz。
工作频率越高,总线工作速度越快,总线带宽也越宽。
总线位宽、工作频率和总线带宽间的关系为:
总线带宽(MBps)=(总线位宽/8)×总线工作频率(MHz)
例如:
32位总线,工作频率33MHz,则:
总线带宽=(32/8)×33=132(MBps)
总线分类及总线标准
一、总线的分类
根据总线所处的位置和应用场合,总线可分为片内总线、片间总线、内总线和外总线四级,如图5-1-5所示。
1.片内总线
片内总线是位于微处理器或半导体集成芯片(如LSI/VLSI)内部,用于连接各部件,如微处理器内部ALU和各种寄存器等,进行信息传送的总线。
由于受芯片面积及对外引脚数的限制,片内总线大多采用单总线结构,这有利于芯片集成度和成品率的提高。
2.片间总线
片间总线又称元件级总线、芯片级总线、片总线或局部总线,是在微型计算机主板、单板机以及其它一些插件板、卡(如各种I/O接口板/卡)等子系统中,连接板/卡上的CPU,RAM,ROM,I/O接口等各种芯片的总线。
3.内总线
内总线是用来连接微型计算机系统中各功能部件的总线,又称系统总线或板级总线。
系统总线是微型计算机系统中最重要的总线,人们平常所说的微型计算机总线就是指系统总线,如微型计算机总线、AT总线(ISA总线)、PCI总线等。
系统总线又可分为数据总线(DB)、地址总线(AB)和控制总线(CB),如图5-1-6中所示。
①数据总线(DB):
传送数据信息,双向的三态总线。
数据总线的位数是微型计算机的一个重要指标,通常与微处理器的字长相一致。
例如Intel8086微处理器字长16位,其数据总线宽度也是16位。
在计算机中指令代码、状态信息、控制信息都称为数据,都可以通过数据总线传送。
②地址总线(AB):
专门传送地址,单向的三态总线。
地址总线的位数决定了CPU可直接寻址的内存空间大小,一般来说,若地址总线为n位,则可寻址空间为2n字节。
如8位微型计算机的地址总线为16位,则其最大可寻址空间为216=64KB。
16位微型机的地址总线为20位,其可寻址空间为220=1MB。
③控制总线(CB):
传送控制信号、时序信号和状态信息等。
控制信号中,有的是微处理器送往存储器和I/O接口电路的,如读/写信号、片选信号、中断响应信号等;也有的是其他部件反馈给CPU的,如中断请求信号、复位信号、总线请求信号、设备就绪信号等。
所以,控制总线是定向的,即每一根线的方向是一定的、单向的。
但在各种结构框图中,控制总线CB作为一个整体,以双向线表示。
4.外总线
外总线也称通信总线,用于两个系统之间的连接与通信。
如两台微型计算机系统之间、微型计算机系统与其他电子仪器或电子设备之间的通信。
常用的通信总线有IEEE-488总线和RS-232串行总线等。
二、总线标准
1.总线标准化的含义
各厂家按相同的几何尺寸,引线信号的定义、数目和时序生产的芯片和插件板/卡,以以保证不同厂家生产的插件板/卡能相互兼容,以满足用户对系统功能的扩充或升级的需要。
2.总线标准
总线标准是指芯片之间、插件板之间及系统之间,通过总线进行连接和传输信息时,应遵守的一些协议与规范,包括硬件和软件两个方面。
如总线插槽/插座的尺寸、引脚、信号线定义、总线工作时钟频率、总线仲裁与配置机构、电气规范和实施总线协议的驱动与管理程序等。
标准化的微型计算机系统总线有ISA总线(AT总线)、PCI总线和AGP总线等。
常用的外总线(通信总线)有RS-232C串行总线和IEEE-488总线等。
三、典型总线
1.PCI总线
PCI(PeripheralComponentInterconnect,外围部件互连)总线是以Intel公司为首的PCI集团推出的一种局部总线标准。
PCI总线的特点:
(1)高性能
PCI总线的数据总线宽度为32位,可扩充到64位,初始工作频率为33MHz。
32位总线宽度时,最大传输率为132MBps;64位数据宽度时,最大传输率达264MBps。
1995年的新标准将工作频率提升为66MHz,与CPU时钟频率无关,其数据传输率当64位时可达528MBps,并支持猝发式数据传送。
(2)兼容性好,易于发展
PCI总线可以与ISA,VL等总线兼容。
由于PCI总线与时钟频率无关,所以可以用不同型号的CPU。
(3)自动配置功能
PCI总线标准中使用了即插即用-PnP(PlugandPlay)技术。
当用户将扩充卡插入PCI系统后,系统的BIOS能根据读到的关于扩充卡的信息,结合系统实际情况,为扩充卡分配存储地址、端口地址、中断和某些定时信息,无需用户干预。
(4)规范
PCI总线标准对通信协议、时序关系、负载、电气特性和机械特性都作了严格的规定。
这是ISA,EISA和VESA所不及的,这也保证了PCI的可靠性和兼容性。
PCI总线在体系结构上,通过PCI桥(PCI总线控制器)实现PCI总线所需要的全部控制。
通过ISA总线扩充控制器(ISA桥)实现PCI到ISA,EISA等的转换。
图5-1-7是用PCI总线构成的微型计算机系统示意图。
2.AGP总线
AGP(AcceleratedGraphicsPort)即加速图形端口。
它是Intel公司为了提高视频带宽,提高微型计算机的图形处理能力,尤其是3D图形的处理能力而开发设计的一种总线规范。
其视频信号的传输速率在“×1”模式可达266MBps,在“×4”模式下可达1066MBps。
比PCI的132MBps至少高出1倍。
PCI总线无法满足描绘3D图形所需的高传输速度要求,增大显存容量又增加了显卡的价格,而采用AGP可以在主内存与显示卡之间提供了一条直接的通道,使3D图形数据越过PCI总线,直接送入显示子系统。
可突破由PCI总线形成的系统瓶颈。
从而实现了以相对低价格来达到高性能3D图形的描绘功能。
实际上,AGP不能称为总线,因为总线可以支持多种设备,而AGP是点对点连接,只连接控制芯片和AGP显示卡。
所以严格地说,AGP只能算是一种端口。
(1)AGP的性能特点
AGP端口是以32位、66MHz的PCIRevision2.1规范为基础,主要做了四方面重大改进:
①对内存的读写操作实行先进的流水线处理。
充分利用等待延时,大大地增加了读内存的速度,使其与写内存的速度相当。
②AGP总线上的地址信号与数据信号分离。
这样设计可以充分利用读写请求与数据传输之间的空闲,使总线效率达到最高。
同时也可以有效地分配系统资源,避免了死锁的发生。
③AGP比PCI多了一种直接内存执行DIME操作模式,能够扩展地直接使用系统内存,可以大大减轻显存的压力。
(2)AGP规范
AGP1.0(AGP1X、AGP2X):
1996年7月,AGP1.0图形标准,分为1X和2X两种模式,数据传输带宽分别达到了266MBps和533MBps,工作频率为66MHz,工作电压为3.3V。
该规范中的AGP带宽很小,目前已基本被淘汰。
(AGP4X):
1998年5月,工作频率依然是66MHz,工作电压降低到了1.5v,并且增加了4X模式,数据传输带宽达到了1066MBp。
AGPPro:
与AGP2.0同时推出,接口比AGP4X略长一些,其加长部分可容纳更多的电源引脚,可以驱动功耗更大(25~110w)或者处理能力更强大的AGP显卡。
该标准完全兼容AGP4X规范,可以安插AGP4X显卡。
(AGP8X):
2000年8月Intel推出,工作电压降到0.8V,并增加了8X模式,数据传输带宽可达2132MBps。
图5-1-8是AGP插槽的示意图,表5-1为AGP标准规范。
表5-1AGP标准规范
(AGP4X)
(AGP8X)
AGP1X
AGP2X
工作频率/MHz
66
66
66
66
传输带宽/MBps
266
533
1066
2132
工作电压/V
单信号触发次数
1
2
4
4
数据传输位宽/b
32
32
32
32
触发信号频率/MHz
66
66
133
266
总线缓冲器
总线作为计算机系统中各部件的公共信息传输通道,当系统运行时各个部件均挂在总线上,为了保证总线上传送数据的正确性,在同一时刻只能允许一个部件向总线发送数据,但允许一个部件或多个部件同时接收数据。
为了达到这一要求,可以在器件内部设置三态缓冲器。
数据通过三态缓冲器再送入总线,当三态缓冲器处于低阻状态,即输出端为高电平或低电平状态时,器件挂在总线上;当三态缓冲器处于高阻状态,即开路状态或浮空状态时,器件与总线逻辑上“脱开”,但物理上仍是连接在一起的。
5.2运算器
运算器是CPU的重要组成部分,是计算机中用来进行算术、逻辑运算的部件。
运算器的核心部件是算术逻辑运算部件ALU。
算术逻辑运算部件(ALU)
ALU的功能:
完成算术和逻辑运算,是运算器的核心。
ALU的结构:
以加法器为基本单元,增加一个逻辑运算功能部件。
图5-2-1所示为ALU的逻辑框图,图5-2-2所示为ALU的逻辑符号。
输入信号Ai、Bi在不同的控制信号的控制下经过逻辑运算功能部件之后产生不同的信号Xi和Yi,然后与进位信号
一起送入加法器进行全加运算,从而达到实现多种算术运算和逻辑运算的目的。
定点运算器
结构:
由ALU、阵列乘除器、通用或专用寄存器组、三态缓冲器以及内部总线等逻辑部件组成。
①ALU:
运算器的核心部件,用来实现算术逻辑运算。
②阵列乘除器:
实现乘法和除法的并行运算。
③寄存器组:
存放操作数、中间运算结果以及运算结果的状态。
④三态缓冲器:
实现对数据的缓存。
种类:
(1)按功能划分,运算器可分为定点运算器和浮点运算器。
定点运算器是计算机进行定点数运算的部件。
定点数的小数点位置固定,因此参与运算的操作数不需重新定位,可直接进行算术运算。
(2)按内部总线的数量,运算器分为单总线、双总线和三总线3种不同的结构。
一、单总线结构的运算器
图5-2-3所示为单总线结构的运算器示意图。
特点:
①所有的部件都连接到同一条总线上,因此在同一时间只能有一个数据通过总线在各部件之间传输。
②一次双操作数的运算,必须分两次来完成操作数向ALU的输入。
③需要A、B两个锁存器来暂时存放将要参加运算的操作数。
例如,当执行一次加法运算时,首先将第一个操作数放入锁存器A中,再将第二个操作数放入锁存器B中,然后两个操作数同时进入ALU中进行加法运算,运算的结果再通过总线放入目的寄存器中。
④控制简单,速度慢。
二、双总线结构的运算器
图5-2-4所示为双总线结构的运算器示意图。
特点:
①采用两条总线来传送操作数,两个操作数可同时送至ALU进行运算。
②运算的结果不能直接送到总线上,必须通过一个缓冲器再送到总线上。
③双总线结构的运算器在速度上要比单总线的快。
三、三总线结构的运算器
图5-2-5所示为三总线结构的运算器示意图。
特点:
①采用两条总线来传送操作数,并且还专门有第三条总线用来传送运算结果。
②只要ALU的运算速度足够快,算术、逻辑运算就可以一步完成。
③总线旁路器用于把不需要通过ALU进行运算的数据直接输出。
④速度最快。
5.3存储器
存储器分类
一、按存储介质分类
1.半导体存储器
以二极管、晶体管或MOS管等半导体器件作为存储元件的,如计算机的内存。
2.磁存储器
以磁性材料作为存储介质。
常用的磁存储器是磁带、磁盘等磁表面存储器,如计算机的硬盘、软盘。
3.光存储器
采用激光技术在记录介质上进行读/写的存储器。
如只读光盘(CD-ROM)等。
二、按存取方式分类
1.随机存储器(RandomAccessMemory,RAM)
随机存储器:
任何一个存储单元的内容都可以随机存取,存取时间与存储单元的物理位置无关。
随机存储器按其电路形式可分为双极型和MOS型。
双极型存储器存取速度快,但是功耗大,集成度小,一般作为容量较小的高速缓冲存储器。
MOS型存储器按MOS工艺制成,分为静态存储器(SRAM)和动态存储器(DRAM)。
动态存储器的存储内容需定时刷新。
2.只读存储器(ReadOnlyMemory,ROM)
只读存储器按其制作工艺和使用特性可分为固定只读存储器(ROM)、可编程只读存储器(PROM)、可擦除可编程只读存储器(EPROM)和电擦除可编程只读存储器(EEPROM)。
①ROM:
内容在生产时事先写入,计算机工作时只能读出,而不能随机写入。
②PROM:
内容是在使用时由用户写入的,一旦写入不能更改。
③EPROM:
由用户写入,紫外线擦除,可多次改写。
④EEPROM:
由用户写入,电脉冲擦除,可多次改写。
3.串行访问存储器(SequentialAccessMemory,SAM)
读写操作按物理位置的先后顺序寻找地址,如磁带。
在微型计算机中使用不多。
三、按在计算机中的作用分类
1.主存储器
主存储器简称主存,也称为内存,通过内存总线与CPU连接,用来存放正在执行的程序和处理的数据,可以和CPU直接交换信息。
内存的常见类型:
①DDRSDRAM(DoubleDataRateSynchronousDynamicRandomAccessMemory,同步双倍速率传输动态随机存储器)是现在的主流内存规范。
图5-3-1是典型DDRSDRAM的外观图。
②RDRAM也称为Rambus(开发它的公司名字),RDRAM的运行频率从300MHz到600MHz,比SDRAM和DDRSDRAM高了许多。
图5-3-2是RDRAM的外观图。
2.辅助存储器
辅助存储器简称辅存,也称为外存,需通过专门的接口电路与主机连接,不能和CPU直接交换信息,用来存放暂不执行或还没被处理的程序或数据。
3.缓冲存储器
缓冲存储器简称缓存(Cache),用在两个速度不同的部件之间,如CPU与主存之间。
4.闪速存储器(FlashMemory)
闪速存储器亦称快擦写存储器,可在不加电的情况下长期保存信息,具有非易失性,能在线快速擦除与重写,兼有EEPROM和SRAM的优点。
是代替EPROM和EEPROM的理想器件,也是未来小型磁盘的替代品。
闪速存储器目前已广泛应用于笔记本电脑和便携式电子通信设备中。
存储器的分类如图5-3-3所示。
静态随机存储器(SRAM)
一、基本存储单元电路
静态存储器的基本存储单元电路如图5-3-4所示。
(1)双稳态触发器:
VT1~VT4构成,两个稳定状态分别表示1或者0,例如A点为高电平,B点为低电平,表示1,相反则表示0。
(2)VT5、VT6:
门控管,当行选择线X为高电平时,VT5、VT6管导通,A点和B点分别与内部数据线D和
(也称位线)接通。
(3)VT7、VT8:
门控管,控制该存储单元的内部数据线是否与外部数据线接通。
当列选择线Y也为高电平时,VT7、VT8管导通,内部数据线与外部数据线接通,表示该单元的数据可以读出或者把外部数据线上的数据写入到该存储单元。
(4)读出:
行选择线X与列选择线Y均为高电平,VT5、VT6、VT7、VT8管均导通,A点与D接通,B点与
接通,D、
又与外部数据线接通,若原来存入的是1,A点为高电平,则D为高电平;B点为低电平,则
为低电平,二者分别通过VT7、VT8管输出到外部数据线,即读出1。
相反,若A点为低电平,则D为低电平;B点为高电平,则
为高电平,二者分别通过VT7、VT8管输出到外部数据线,即读出0。
读出信息时,双稳态触发器的状态不受影响,故为非破坏性读出。
(5)写入:
首先将要写入的数据送到外部数据线上。
若该单元被选中,则行选择线X与列选择线Y为高电平,VT5、VT6、VT7、VT8管均导通,外部数据线上的数据就分别通过VT7、VT5管和VT8、VT6管送到触发器的A点与B点,若写入的是1,则VT2导通,B点为低电平,VT1截止,A点为高电平,写入结束,状态保持;若写入的是0,则状态相反,A点为低电平,B点为高电平。
但如果电源掉电后又恢复供电时,双稳态触发器发生状态竞争,即掉电前写入的信息不复存在,因此SRAM被称为易失性存储器。
二、静态RAM的组成
静态RAM一般是由存储体、地址译码电路、读/写驱动电路、控制电路、地址寄存器和数据缓冲器组成,其结构组成原理图如图5-3-5所示。
1.存储体
存储体是存储信息的实体,由若干个能存储一位二进制数的位存储单元构成。
图5-3-5所示RAM中的存储体是一个由64×64=4096个六管静态存储电路组成的存储矩阵。
2.译码电路
用于对来自CPU的地址码进行译码,以便选择地址码所指定的存储单元。
图5-3-5所示RAM中,采用了双译码方式,X地址译码器输出端提供X0~X63共64根行选择线,而每一行选择线接在同一行中的64个存储电路的行选端,故行选择线能同时为该行64个行选端提供行选择信号。
Y地址译码器输出端提供Y0~Y63计64根列选择线,而同一列中的64个存储电路共用同一位线,故由列选择线可以同时控制它们与输入/输出电路(I/O电路)连通。
很显然,只有行、列均被选中的某个单元存储电路,在其X向选通门与Y向选通门同时被打开时,才能进行读出信息和写入信息的操作。
3.I/O电路
用于读出/写入信息。
图5-3-5中所示的存储体是容量为4K×1b的存储器,因此,它仅有一个I/O电路。
如果要组成字长为4位或8位的存储器,则每次存取时,同时应有4个或8个单元存储电路与外界交换信息,这种存储器中,将列按4位或8位分组,每根列选择线控制一组的列向门同时打开;相应地I/O电路也应有4个或8个,每一组的同一位,共用一个I/O电路。
I/O电路还有对读出的信息进行放大的作用。
4.控制电路
对存储芯片进行选择及对选中的存储单元进行读/写控制。
在实际应用中,一个RAM芯片的存储容量很难满足要求,所以存储器一般是由多个存储芯片构成的。
这样,地址不同的存储单元,可能处于不同的芯片中,因此,在选择地址时,应先选择其所属的芯片。
这一工作是
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