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4510做计数器
《电子设计基础》
课程设计报告
(2011——2012学年第二学期)
设计题目:
用4510设计一个24/12计数器
专业班级:
姓名:
学号:
指导老师:
日期:
2012年5月16日
一、设计任务:
用4510设计一个24/12进制计数器:
结果用数码管显示,用开关切换两种进制方式,从0开始计数。
二、设计要求:
1.用4510设计一个24/12进制计数器;
2.结果用数码管显示;
3.用开关切换两种进制方式;
4.从0开始计数。
三、设计内容:
1.设计思想
要用一个芯片设计一个计数器首先必须对这个芯片有所了解,再慢
慢地掌握它。
从题目可以看出,要设计的计数器的核心部位在于4510
这个芯片。
通过对4510芯片的学习以及了解才能着手整个计数器的设计。
首先,可以通过查询资料(包括图书馆、网上、以及像对芯片比较熟悉的同学请教)得到4510的主要组成部分和主要功能实现方法,我通过对4510芯片的介绍,基本可以确定计数规则。
这个时候它还是一个普通的计数器。
要实现24/12进制计数器还需要通过逻辑门对4510的输出进行控制。
基本方法是使两片4510的输出到24/12时通过逻辑门对4510进行反馈,再重新开始计数,这样子便实现了24/12进制。
这个电路图还要要求将结果显示到数码管,我们若想把上面部分的
输出结果显示到数码管,因为4510的计数是二进制的,所以可以用两
因为要实现从0开始计数,所以可以用置0法,因为4510有清0复位,和置位两种机制。
以上就是我设计的大体思想以及实现方法。
2.系统方案以及电路结构框图
先对4510芯片的结构以及功能进行了解
(1)4510引脚图
(2):
CD4511简单功能:
CD451(为一位十进制加/减可逆循环计数器,六个与非门与四个或非
门构成了不循环控制电路。
由开关
来选择计数器的“加”、“减”,当开关接高电平时为加,当开关接低
电平时为减。
为防止电压过高,开关
接上拉电阻到+5V,
阻值定为10K。
表3-1CD4510逻辑功能表
Cn
PE
R
工作状态
1
X
0
0
停止计数
0
1
0
0
加法计数
0
0
0
0
减法计数
X
X
1
0
预置数
X
X
X
1
复位
表3-1为CD4510的逻辑功能表,通过上表可以得到加减不循环控制
的原理。
当
输出为
接高电平时,通过与非门和或非门
的控制,反馈为高电平,此时停止
加法计数。
同理,当
输出为
接低电平时
反馈为高电平,此时停止减法计数。
1.只有BCD计数功能,故无B/D(二进制/十进制)控制脚。
2.具有清除控制功能,故多了一只清除控制端R。
清除端R在使用上具有最高优先权,
及当R=1则Q不论其它输入为何,其输出QDQcQBQ必皆被清除为
0,令R=0,正
常计数,其接脚图如图1。
在CD4029与CD4510中,都设有进位输入端Ci
及进位输出端CQ以供做串联使用。
其功能:
Ci:
进位输入端,当其为1,则clock输入都无效,只有在Ci=0时,clock的正缘
触发才能使计数器计数。
Co:
进位输出端,平常输出都保持在1,只有在上数计数到9,或下数计数到0时才
会变为0输出,以作为进位或借位之准备,直到下一个时序信号的正缘输入后
才转为1。
因此做计数器串联时,需将个位数Ci接地,而将其Co接到十位数计数的Ci中,
2.电路如下:
12进制A
1224进制A
13
U1
U12
U3
4
vcc
5VV1
P1
Q1
P2
Q2
P3
Q3
P4
Q4
PE
CO
R
CI
U/~D
〉CLK
4510BD
5V
6
11
14
2
1■9~
10
孑__1
4
P1
Q1
P2
Q2
P3
Q3
P4
Q4
PE
CO
R
CI
U/~D
、CLK
4510BD
5V
10
15
GREDEX_I
□7—
10
i_RED
20Hz
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