9北邮电子电路模拟题与答案Word文档下载推荐.docx

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已知输入信号的频率为10kHz〜12kHz,为了防止干扰信号的混入，应选用滤波电路。

为了获得输入电压中的低频信号，应选用滤波电路。

A带阻B带通C低通

（8）理想运算放大器的两个输入端的输入电流等于零，其原因是（）。

A同相端和反相端的输入电流相等而相位相反

B运放的差模输入电阻接近无穷大

C运放的开环电压放大倍数接近无穷大

（9）

（）。

在运算放大器电路中，引入深度负反馈的目的之一是使运放

A工作在线性区，降低稳定性

B工作在非线性区，提高稳定性

C工作在线性区，提高稳定性

R

I）,

O

打

I）

（10）电路中D1和D2管的作用是消除。

A饱和失真B.截止失真C交越失真

O.

i-

三：

计算题（每小题15分，共45分）

Rn

t

R.

4k

+

n

+Vcc

+12V

c

丄r

\s二

、

B

Vi

50FVo

e

「Jw图所示电路参数理想对称，晶体管的电流放大倍数0-0'

0二15"

?

「殛厂厂

（1）计算/?

百滑动端在中点时TI管和1\管的发射极静态电流/EQ；

Q）计算动态参数和Rj；

*

*

Ml

R、

10k（）

vc（0）=0。

例3在如图所示的电路中，A1和A2为理想运放，电容的初始电压

（1）写出Vo与Vi1、Vi2和Vi3之间的关系式；

R1=R2=R3=R4=R5=R6R，输出电压Vo的表达式。

写出当电路中的电阻

数字部分

.判断题：

（10分）（在本题下方的表格中对应题号填入"

或X）

1.电路的输出仅取决于电路当前的输入，该电路为组合逻辑电路。

2.由与、或、非门电路构成的逻辑电路一定是组合逻辑电路。

3.TTL与非逻辑门的某输入端悬空时，可认为输入是逻辑“1”。

4.若让TTL电路的某输入端接低电平，可直接接地或通过任意阻值的电阻接地5.OC门的输出相互连接并接上拉电阻后，实现“线或”功能。

2.

可能为多选题。

）

选择填空题（20分，每空2分）（将正确答案填入本题下方的表格中

1.若输入AB均为1时，输出F=0，否则输出F=1，输入和输出之间的逻辑关系为：

2人在图£

-1^TTL门电路

1

（A）异或（B）同或（C）与非（D）或非

中，输出为高电平的有（）

11

JK

J；

JK-

4■J"

F三（人4B*（_hD1（（一+D"

B+

IA1F=IA—B+CbA*Dm「一D>

<

B）F=*A十E-ChAD>

5.已知某TTL门电路的输出端最大灌电流负载能力为4mA最大拉电流负载能力为2mA

其输入端低电平的输入最大电流为-1mA（流出输入端），输入端高电平时的输入最大电流为

0.1mA（流入输入端），该门电路的扇出系数为：

（A）40（B）4（C）20（D）2

进制数58对应的等值二进制数是（）

6.

（A）（101011）2（B）（111010）2（C）（110011）2（D）（100010）2

10分）

7.用以下（）电路构成模8计数器时，实现脉冲分配器的译码电路最简单（A）同步计数器（B）异步计数器（C）环形计数器（D）扭环形计数器

3.组合逻辑分析设计（

根据逻辑图写出输出F的表达式。

采用卡诺图法简化该电路，写出最简与或表达式。

用最少的或非门实现上述逻辑函数，画出逻辑图。

逻辑电路见图3-1，输入变量为ABCD（包括反变量），输出端为F。

要求:

B一

&

■&

L）

B

-“

A-BD

4.

15分）

5-1所示的逻辑功能。

数据选择器的A2A1A0为地址输入端，

ABC数据选择器的输出逻辑函数

中规模组合逻辑设计（试用八选一数据选择器实现表

DO〜D7为数据输入端，要求使用A2A1A0分别接输入信号式为：

}=Q1.4*・-1I+D]1・丄（-4-7-1）

▼QI./弓■£

）—Z）j■』一£

•£

」

亠DjaAA^^DaA.AA-一A^AAA

■卜1匸ri■M*

要求完成：

（1）在给出的真值表中填入输出值（表5-2）;

（2）在图5-1所示片脚图上标明DO—D7的输入信号。

S1

AB

Z

0■>

CD

H1

C-D

10

CiD

11

C+D

D.D

-y

■

ABCD

z

0（JC0

<

1001

）010

0CH1

01<

j0

01（11

0110

VI11

10C0

1<

1C1

1010

lull

1100

1HJ1

1110

1111

上S-

•r亠■

五.同步时序电路分析（10分）图下为一同步时序电路，

000）

作为计数器时，该电路为几进制计数器？

作出状态转移图。

能否自启动？

作为序列信号发生器时，从Q2输出的信号序列是什么？

（设初始状态为

六.中规模时序逻辑设计（

74LS561为四位二进制同步加法计数器。

功能表如表示（QD为高位输出）。

其

7-1所RCC为与

时钟同步的进位输出，进入

表7-174LS561功能表

中OC为输出高阻控制端，

1111状态后由RCO端输出负脉冲。

■SiCZW

、CLR

CPD<

BA

0（：

QdQtQ弓Qa

MLR

请使用最少外围逻辑器件，采用同步预置法、异步复位法分别实现九进制计数器，在对应的图上画出连接线；

标出控制端的电平、预置法（作为预置控制信号）实现时的预置值；

采用复位法实现计数器时，外部器件要求使用与非门。

参考答案

一.判断题

（1）v

（2）X（3）v（4）X（5）v

选择填空题

（1）B,B

（2）D（3）C（4）C（5）带阻（6）带通（7）C（8）B（9）C（10）C三：

计算题

1:

CC

%SOOkQ

=50<

40）1A=2inA

CE

CC/c^c=12\—2mA，4kQ=4V

（2）仏204）0+11+

R=/t=4kQ

«

c

IFLlI

2:

解=

SrnT：

（1）1\管和K管的发射极静态电流分析

tijrT-乂巴」八亡■tt

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I*EE*DEu.-,-\

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份崭如下：

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3:

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4

Il+r）"

数字部份一：

判断题

12345

VxVxx

二.选择填空题

1234567

CDACABBC

.组合逻辑分析设计（10分）

四:

'

F=SD♦-4BD一ABD+BCD

-F二D-EC

D

中规模组合逻辑设计（

15分）

答案:

ABCD

000（■）

0001

0010

0011

0100

0101

〔1

0110

0111

1000

1001

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1011

11Cl1

L1I1

1

A

I

A.

D-J,D-D一0工>

工

五.同步时序电路分析（10分）

中规模时序逻辑设计（

CP

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