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管,为什么?
20、给出多个
mos
管组成的电路求
5
个点的电压。
21、电压源、电流源是集成电路中经常用到的模块,请画出你知道的线路结构,简单描述
其优缺点。
22、画电流偏置的产生电路,并解释。
23、史密斯特电路,求回差电压。
(华为面试题)
24、晶体振荡器,好像是给出振荡频率让你求周期(应该是单片机的,12
分之一周期....)(华
为面试题)
25、LC
正弦波振荡器有哪几种三点式振荡电路,分别画出其原理图。
26、VCO
是什么,什么参数(压控振荡器?
)
27、锁相环有哪几部分组成?
28、锁相环电路组成,振荡器(比如用
D
触发器如何搭)。
29、求锁相环的输出频率,给了一个锁相环的结构图。
30、如果公司做高频电子的,可能还要
RF
知识,调频,鉴频鉴相之类,不一一列举。
(未
知)
31、一电源和一段传输线相连(长度为
L,传输时间为
T),画出终端处波形,考虑传输线
无损耗。
给出电源电压波形图,要求绘制终端波形图。
32、微波电路的匹配电阻。
33、DAC
ADC
的实现各有哪些方法?
34、A/D
电路组成、工作原理。
35、实际工作所需要的一些技术知识(面试容易问到)。
如电路的低功耗,稳定,高速如何
做到,调运放,布版图注意的地方等等,一般会针对简历上你所写做过的东西具体问,肯定
会问得很细(所以别把什么都写上,精通之类的词也别用太多了),这个东西各个人就
不
一样了,不好说什么了。
_______________________________________________________________________
数字电路
1、同步电路和异步电路的区别是什么?
2、什么是同步逻辑和异步逻辑?
(汉王笔试)
同步逻辑是时钟之间有固定的因果关系。
异步逻辑是各时钟之间没有固定的因果关系。
3、什么是"
线与"
逻辑,要实现它,在硬件特性上有什么具体要求?
线与逻辑是两个输出信号相连可以实现与的功能。
在硬件上,要用
oc
门来实现,由于不用
门可能使灌电流过大,而烧坏逻辑门。
同时在输出端口应加一个上拉电阻。
4、什么是
Setup
Holdup
时间?
5、setup
holdup
时间,区别.(南山之桥)
6、解释
setup
time
hold
的定义和在时钟信号延迟时的变化。
7、解释
violation,画图说明,并说明解决办法。
(威盛
VIA
2003.11.06
上海笔试试题)
Setup/hold
是测试芯片对输入信号和时钟信号之间的时间要求。
建立时间是指触发
器
的时钟信号上升沿到来以前,数据稳定不变的时间。
输入信号应提前时钟上升沿(如上升
沿有效)T
时间到达芯片,这个
就是建立时间-Setup
time.如不满足
time,这个数据就
不能被这一时钟打入触发器,只有在下一个时钟上升沿,数据才能被打入触发器。
保持时
间是指触发器的时钟信号上升沿到来以后,数据稳定不变的时间。
如果
不够,
数据同样不能被打入触发器。
建立时间(Setup
Time)和保持时间(Hold
time)。
建立时间是指在时钟边沿前,数据信
号需
要保持不变的时间。
保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。
如果不
满足建立和保持时间的话,那么
DFF
将不能正确地采样到数据,将会出现
metastability
的
情况。
如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时
间,那么超过量就
分别被称为建立时间裕量和保持时间裕量。
8、说说对数字逻辑中的竞争和冒险的理解,并举例说明竞争和冒险怎样消除。
(仕兰微
电
子)
9、什么是竞争与冒险现象?
怎样判断?
如何消除?
在组合逻辑中,由于门的输入信号通路中经过了不同的延时,导致到达该门的时间不一致
叫竞争。
产生毛刺叫冒险。
如果布尔式中有相反的信号则可能产生竞争和冒险现象。
解决
方法:
一是添加布尔式的消去项,二是在芯片外部加电容。
10、你知道那些常用逻辑电平?
TTL
与
COMS
电平可以直接互连吗?
常用逻辑电平:
12V,5V,3.3V;
不可以直接互连,由于
是在
0.3-3.6V
之间,而
则是有在
12V
的有在
5V
的。
输出接到
是可以直接互连。
TTL
接到
需要在输出端口加一上拉电阻接到
或者
12V。
11、如何解决亚稳态。
(飞利浦-大唐笔试)
亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。
当一个触发器进入亚
稳态时,既无法预测该单元的输出电平,也无法预测何时输出才能稳定在某个正确的电平
上。
在这个稳定期间,触发器输出一些中间级电平,或者可能处于振荡状态,并且这种无
用的输出电平可以沿信号通道上的各个触发器级联式传播下去。
12、IC
设计中同步复位与
异步复位的区别。
(南山之桥)
13、MOORE
MEELEY
状态机的特征。
14、多时域设计中,如何处理信号跨时域。
15、给了
reg
setup,hold
时间,求中间组合逻辑的
delay
范围。
Delay
period
-
–
hold
16、时钟周期为
T,触发器
D1
的建立时间最大为
T1max,最小为
T1min。
组合逻辑电路最
大延
迟为
T2max,最小为
T2min。
问,触发器
D2
的建立时间
T3
和保持时间应满足什么条件。
(华
为)
17、给出某个一般时序电路的图,有
Tsetup,Tdelay,Tck->
q,还有
clock
delay,写出决
定最大时钟的因素,同时给出表达式。
VIA
18、说说静态、动态时序模拟的优缺点。
19、一个四级的
Mux,其中第二级信号为关键信号
如何改善
timing。
20、给出一个门级的图,又给了各个门的传输延时,问关键路径是什么,还问给出输入,
使得输出依赖于关键路径。
21、逻辑方面数字电路的卡诺图化简,时序(同步异步差异),触发器有几种(区别,优
点),全加器等等。
22、卡诺图写出逻辑表达使。
23、化简
F(A,B,C,D)=
m(1,3,4,5,10,11,12,13,14,15)的和。
(威盛)
24、please
show
the
inverter
schmatic,layout
and
its
cross
sectionwith
P-
well
process.Plot
transfer
curve
(Vout-Vin)
And
also
explain
the
operation
region
of
PMOS
NMOS
for
each
segment
curve?
(威
盛笔试题
circuit
design-beijing-03.11.09)
25、To
design
a
invertor
with
balance
rise
fall
time,please
define
ration
channel
width
explain?
26、为什么一个标准的倒相器中
P
管的宽长比要比
管的宽长比大?
27、用
管搭出一个二输入与非门。
(扬智电子笔试)
28、please
draw
transistor
level
schematic
cmos
2
input
AND
gate
and
which
has
faster
response
output
rising
edge.(less
delay
(威盛笔试题
29、画出
NOT,NAND,NOR
的符号,真值表,还有
的电路。
笔
试)
30、画出
的图,画出
tow-to-one
mux
gate。
31、用一个二选一
和一个
inv
实现异或。
32、画出
Y=A*B+C
电路图。
(科广试题)
33、用逻辑们和
电路实现
ab+cd。
34、画出
电路的晶体管级电路图,实现
Y=A*B+C(D+E)。
35、利用
4
选
1
实现
F(x,y,z)=xz+yz’。
36、给一个表达式
f=xxxx+xxxx+xxxxx+xxxx
用最少数量的与非门实现(实际上就是化
简)。
37、给出一个简单的由多个
组成的原理图,根据输入波形画出各点波形。
笔试)
38、为了实现逻辑(A
XOR
B)OR
(C
D),请选用以下逻辑中的一种,并说明为什
么?
1)INV2)AND3)OR4)NAND5)NOR6)XOR答案:
NAND(未知)
39、用与非门等设计全加法器。
(华为)
40、给出两个门电路让你分析异同。
41、用简单电路实现,当
A
为输入时,输出
B
波形为…(仕兰微电子)
42、A,B,C,D,E
进行投票,多数服从少数,输出是
F(也就是如果
A,B,C,D,E
的个数比
多,那么
F
输出为
1,否则
为
0),用与非门实现,输入数目没有限制。
43、用波形表示
触发器的功能。
44、用传输门和倒向器搭一个边沿触发器。
45、用逻辑们画出
触发器。
46、画出
的结构图,用
verilog
实现之。
47、画出一种
锁存器的电路图和版图。
48、D
触发器和
锁存器的区别。
(新太硬件面试)
49、简述
latch
filp-flop
的异同。
50、LATCH
的概念和区别。
51、latch
register
的区别,为什么现在多用
register.行为级描述中
如何产生的。
52、用
触发器做个二分颦的电路.又问什么是状态图。
53、请画出用
触发器实现
倍分频的逻辑电路?
54、怎样用
触发器、与或非门组成二分频电路?
(东信笔试)
55、How
many
flip-flop
circuits
are
needed
to
divide
by
16?
(Intel)
16
分频?
56、用
logic-gate
设计一个
位加法器,输入
carryin
current-stage,输出
carryout
next-stage.
57、用
触发器做个
进制的计数。
58、实现
位
Johnson
Counter,N=5。
59、用你熟悉的设计方式设计一个可预置初值的
7
进制循环计数器,15
进制的呢?
(仕兰
微电子)
60、数字电路设计当然必问
Verilog/VHDL,如设计计数器。
61、BLOCKING
NONBLOCKING
赋值的区别。
62、写异步
触发器的
module。
module
dff8(clk
reset,
d,
q);
inputclk;
inputreset;
[7:
0]
d;
q;
reg[7:
always
@
(posedge
clk
or
posedge
reset)
if(reset)
q
=
0;
else
endmodule
63、用
倍分频的
Verilog
描述?
divide2(
clk_o,
reset);
inputclk
reset;
outputclk_o;
wire
in;
out
;
(
if
assign
in
~out;
clk_o
out;
64、可编程逻辑器件在现代电子设计中越来越重要,请问:
a)
你所知道的可编程逻辑器
件有哪些?
b)
试用
VHDL
或
VERILOG、ABLE
描述
8
触发器逻辑。
PAL,PLD,CPLD,FPGA。
inputd;
65、请用
HDL
描述四位的全加法器、5
分频电路。
66、用
VERILOG
写一段代码,实现
进制计数器。
67、用
写一段代码,实现消除一个
glitch。
68、一个状态机的题目用
实现(不过这个状态机画的实在比较差,很容易误解
的)。
69、描述一个交通信号灯的设计。
70、画状态机,接受
1,2,5
分钱的卖报机,每份报纸
分钱。
71、设计一个自动售货机系统,卖
soda
水的,只能投进三种硬币,要正确的找回钱
数。
(1)画出
fsm(有限状态机);
(2)用
编程,语法要符合
fpga
设计
的要求。
72、设计一个自动饮料售卖机,饮料
分钱,硬币有
分和
分两种,并考虑找零:
(1)
画出
设计的要求;
(3)设计
工程中可使用的工具及设计大致过程。
73、画出可以检测
10010
串的状态图,并
74、用
FSM
101101
的序列检测模块。
为输入端,b
为输出端,如果
连续输入为
1101
则
b
1,否则为
0。
例如
a:
0001100110110100100110
b:
0000000000100100000000
请画出
state
machine;
请用
RTL
描述其
machine。
75、用
verilog/vddl
检测
stream
中的特定字符串(分状态用状态机写)。
(飞利浦-大唐
76、用
verilog/vhdl
写一个
fifo
控制器(包括空,满,半满信号)。
77、现有一用户需要一种集成电路产品,要求该产品能够实现如下功能:
y=lnx,其中,x
位二进制整数输入信号。
y
为二进制小数输出,要求保留两位小数。
电源电压为
3~5v
假
设公司接到该项目后,交由你来负责该产品的设计,试讨论该产品的设计全程。
(仕兰微
电子)
78、sram,falsh
memory,及
dram
的区别?
79、给出单管
DRAM
的原理图(西电版《数字电子技术基础》作者杨颂华、冯毛官
205
页
图
9
-14b),问你有什么办法提高
refresh
time,总共有
个问题,记不起来了。
(降低温
度,增大电容存储容量)(Infineon
80、Please
common
SRAM
cell
6
transistors,point
out
nodes
can
store
data
node
is
word
line
control?
(威盛笔试题
81、名词:
sram,ssram,sdram
名词
IRQ,BIOS,USB,VHDL,SDR
IRQ:
Interrupt
ReQuest
BIOS:
Basic
Input
Output
System
USB:
Universal
Serial
Bus
VHDL:
VHIC
Hardware
Description
Language
SDR:
Single
Data
Rate
压控振荡器的英文缩写(VCO)。
动态随机存储器的英文缩写(DRAM)。
名词解释,无聊的外文缩写罢了,比如
PCI、ECC、DDR、interrupt、pipeline、
IRQ,BIOS,USB,VHDL,VLSI
VCO(压控振荡器)
RAM
(动态随机存储器),FIR
IIR
DFT(离散
傅立叶变换)或者是中文的,比如:
a.量化误差
b.直方图
c.白平衡
____________________________________________________________________________
IC
设计基础(流程、工艺、版图、器件)
1、我们公司的产品是集成电路,请描述一下你对集成电路的认识,列举一些与集成电路
相关的内容(如讲清楚模拟、数字、双极型、
CMOS、MCU、RISC、CISC、DSP、ASIC、FPGA
等的概念)。
(仕兰微面试题目)
2、FPGA
ASIC
的概念,他们的区别。
答案:
FPGA
是可编程
ASIC。
ASIC:
专用集成电路,它是面向专门用途的电路,专门为一个用户设计和制造的。
根据一
个用户的特定要求,能以低研制成本,短、交货周期供货的全定制,半定制集成电路。
与
门阵列等其它
ASIC(Application
Specific
IC)相比,它们又具有设计开发周期短、设计
制造成本低、开发工具先进、标准产品无需测试、质量稳定以及可实时在线检验等优点
3、什么叫做
OTP
片、掩膜片,两者的区别何在?
4、你知道的集成电路设计的表达方式有哪几种?
5、描述你对集成电路设计流程的认识。
6、简述
等可编程逻辑器件设计流程。
7、IC
设计前端到后端的流程和
eda
工具。
8、从
synthesis
到
tape
之间的设计
flow,并列出其中各步使用的
tool.(未知)
9、Asic
flow。
10、写出
asic
前期设计的流程和相应的工具。
11、集成电路前段设计流程,写出相关的工具。
先介绍下
开发流程:
1.)代码输入(design
input)
用
vhdl
或者是
语言来完成器件的功能描述,生成
hdl
代码
语言输入工具:
SUMMITVISUALHDL
MENTORRENIOR
图形输入:
composer(cadence);
viewlogic
(viewdraw)
2.)电路仿真(circuit
simulation)
将
vhd
代码进行先前逻辑仿真,验证功能描述是否正确
数字电路仿真工具:
Verolog:
CADENCEVerolig-XL
SYNOPSYSVCS
MENTORModle-sim
:
CADENCENC-vhdl
SYNOPSYSVSS
模拟电路仿真工具:
***ANTI
HSpice
pspice,spectre
micro
microwave:
eesoft
hp
3.)逻辑综合(synthesis
tools)
逻辑综合工具可以将设计思想
代码转化成对应一定工艺手段的门
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- 电子 面试 题目 分解