数电选择题2及答案详解Word文档格式.docx
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数电选择题2及答案详解Word文档格式.docx
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参考T
A4:
逻辑函数Y(A,B,C,D)=∑m(0,2,4,6,9,13)+d(1,3,5,7,11,15)的最简与或式为()(5分)
AD+A'
D'
A'
+D
A+D
C+AD
B
化简具有无关项的逻辑函数最好用卡诺图的方法。
5:
图中为TTL门电路,其输出为()状态(2分)
'
高电平
低电平
高阻态
不确定
知识点:
图示中,控制端低电平电平有效。
控制端无效时输出为高阻态
6:
逻辑函数Y=(A'
+D)(AC+BC'
)'
+ABD'
的Y'
是()(2分)
(AD'
+(A'
+C'
)(B'
+C))(A'
+B'
+D)
+((A'
+C))'
)(A'
+D)
AD'
+C)(A'
(A'
利用反演定理求Y'
时,要注意:
利用加括号的方式保证原来的运算顺序不变;
非单个变量上的非号不变。
7:
()的特性方程为Q*=A(2分)
D触发器
T触发器
JK触发器
SR触发器
A
Q*=DD触发器的特性方程为知识点:
8:
组合逻辑电路消除竞争冒险的方法有((2分)
修改逻辑设计
在输出端接入滤波电容
后级加缓冲电路
屏蔽输入信号的尖峰干扰
输出端接入滤波电容可以滤除竞争冒险产生的尖峰
9:
(1001111)2的等值十进制数是()(2分)
97
15.14
83
79
把二进制数转换为等值的十进制数,只需将二进制数按多项式展开,然后把所有各项的数值按十进制数相加。
10:
有一个或非门构成的SR锁存器,欲使该锁存器保持原态即Q*=Q,则输入信号应为()。
(2分)
S=R=0
S=R=1
S=1,R=0
S=0,R=1
或非门构成的SR锁存器的特性为:
R=1,S=0Q*=0,Q*'
=1,即锁存器被置0(0状态);
R=0,S=1Q*=1,
Q*'
=0,即锁存器被置1(1状态);
R=S=0,Q*=Q,即锁存器保持原态;
R=S=1Q*=Q*'
=0,此为不允许输入。
11:
逻辑函数Y(A,B,C)=∑m(6,7),约束条件:
m0+m4+m5=0的最简与或式为()(5分)
A+B'
C'
AB
A
B
12:
下图电路中,74LS161构成了()(5分)
十四进制计数器
十进制计数器
八进制计数器
三进制计数器
您选择的答案:
161是十六进制计数器,每当计数器计成Q3Q2Q1Q0=0011状态时,由与非门输出低电平信号给LD'
端,剩下十四个状态循环计数。
和0101两个状态跳过,Q3Q2Q1Q0=0110下一个时钟信号到来时将计数器置成,将0100
13:
欲使D触发器按Q*=Q'
工作,应使输入D=()。
0
1
Q
Q'
D触发器的特性为:
D=0时,Q*=0,即触发器被置0(0状态);
D=1时,Q*=1,即触发器被置1(1状Q*=D态);
即:
14:
三变量的全部最小项有()(2分)
3个
6个
8个
9个
个。
n变量的最小项应有2n知识点:
15:
8线—3线优先编码器74HC148输入端I1'
、I5'
同时有效时输出二进制数为(2分)
101
100
001
010
优先编码器74HC148中的输入端I5'
比I1'
的优先权高,所以对I5'
的信号进行编码,但74HC148输出的是反码
16:
由图所示的CLK和D信号波形,上升沿触发的D触发器Q端波形为()(设Q初态为0)。
(5分)
图A
图B
图C
图D
D=1时,Q*=1,即触发器被置1(1状态);
Q*=D
17:
常用的BCD码有()(2分)
奇偶校验码
格雷码
8421码
ASCII码
C
18:
图中为CMOS门电路,其输出为()状态(2分)
选择的答案:
对于OC门电路,门电路输出端直接连接时,逻辑关系为与
19:
在下列逻辑电路中,不是组合逻辑电路的有(2分)
译码器
编码器
全加器
寄存器
寄存器为时序逻辑电路
20:
8位移位寄存器,串行输入时经()个脉冲后,8位数码全部移入寄存器中。
2
4
8
对于移位寄存器,每输入一个脉冲,寄存器中的信息移动一次。
21:
下列说法不正确的是()(2分)
卡诺图化简时所依据的原理是:
具有相邻性的最小项可以合并,并消去不同的因子
卡诺图中排列呈矩形的4个相邻的最小项可以合并为一项,消去2对因子
卡诺图中排列呈矩形的6个相邻的最小项可以合并为一项,消去3对因子
卡诺图中排列呈矩形的8个相邻的最小项可以合并为一项,消去3对因子
卡诺图化简逻辑函数时所依据的原理是:
具有相邻性的最小项可以合并,并消去不同的因子;
合并最小项的规对因子个最小项相邻并排列成一个矩形组,则它们可以合并为一项,消去n2n则是:
如果有
22:
同步时序电路中,所有触发器状态的变化都是同时发生的
异步时序电路的响应速度与同步时序电路的响应速度完全相同
异步时序电路的响应速度比同步时序电路的响应速度慢
异步时序电路中,触发器状态的变化不是同时发生的
在同步时序电路中,所有触发器状态的变化都是在同一时钟信号操作下同时发生的;
而异步时序电路中,触发器状态的变化不是同时发生的。
一般地,异步时序电路的响应速度比同步时序电路的响应速度慢。
23:
下图电路中,当控制变量M为1和0时电路分别为()进制计数器(5分)
13和10
9和12
10和13
12和9
时由下面的与门产生复位信号。
M为0知识点:
本电路为可控进制计数器。
M为1时由上面的与门产生复位信号,24:
利用代入定理可将基本公式中的摩根定理推广为多变量的形式
将逻辑式Y中的所有“?
”和“+”互换,“0”和“1”互换,就可得到Y′
摩根定理只是反演定理的一个特例
”和“+”互换,“0”和“1”互换,就可得到YD
区分反逻辑式和对偶式的变换方法:
”和“+”互换,“0”和“1”互换,可得到YD;
将逻辑。
“1”互换,原变量和反变量互换,可得到Y′“?
”和“+”互换,“0”和式Y中的所有
25:
下列哪个逻辑门可以实现吸收大负载电流功能(2分)
卤门
三态门
传输门
OD门
关系,可以实现吸收大负载电流功能线与门输出并联使用形成“”知识点:
OD26:
要使触发器实现异步复位功能Q*=0,则异步控制端为()(2分)
RD'
=0,SD'
=1
=1,SD'
=0
=1
SD'
叫异步置位端,RD'
叫异步复位端。
只要在SD'
或RD'
加入低电平,即可立即将触发器置1或置1,而不应处于高电平。
和RD'
受时钟信号和输入信号的控制。
触发器正常工作时,
27:
不可以作为同步时序逻辑电路存储元件的触发器是()(2分)
SR锁存器
D触发器
构成同步时序逻辑电路存储元件的触发器必须是具有时钟控制的。
28:
(1110.101)2的等值八进制数是()(2分)
15.1
16.5
15.5
16.1
把每三位二进制数分为一组,用等值的八进制数表示。
。
29:
函数F=A′C′+AB+B′C′,当变量取值为()时,将不出现冒险现象(5分)
B=C=1
B=C=0
A=1,C=0
A=0,B=0
A+A′的形式就不会存在竞争冒险知识点:
在其他变量取所有值时,如果不出现30:
下图电路中,触发器构成了()(5分)
二进制计数器
四进制计数器
五进制计数器
31:
逻辑代数有与、或、非三种基本运算
任何一个复合逻辑都可以用与、或、非三种基本运算构成
异或和同或与与、或、非运算无关
同或和异或互为反运算
异或和同或也是由与、或、非三种基本运算构成的复合运算
32:
时序电路的异步复位信号作用于复位端时,可使时序电路()复位。
在CLK上升沿
在CLK下降沿
在CLK为高电平期间
立即
加入低电平,即可立即将触发器置1或置0,而不RD'
应处于高电平。
触发器正常工作时,SD'
和33:
逻辑函数Y=AC+B'
C+BD'
+CD'
+A(B+C'
)+A'
BCD'
+AB'
DE的最简与或式为()(5分)
A+BD'
AC+B'
由于变量数较多,此题可用公式法化简。
34:
构成一个五进制的计数器至少需要()个触发器(2分)
5
3
n个触发器可构成一个不大于2n进制的计数器
35:
在下图所示电路中,能完成Q*=0逻辑功能的电路有()。
D触发器的特性方程为Q*=D;
JK触发器的特性方程为:
Q*=JQ′+K′Q;
T触发器的特性方程为:
Q*=
(约束条件)触发器的特性方程为:
Q*=S+R′Q,SR=0TQ′+T′Q;
SR
寄存器为时序逻辑电路您选择的答案:
合并最小项的规n对因子则是:
如果有2n个最小项相邻并排列成一个矩形组,则它们可以合并为一项,消去您选择的答案:
而异步时序电路中,触发器状态的变化不是同时发生的。
M为1时由上面的与门产生复位信号,您选择的答案:
将逻辑Y′。
“0”和“1”互换,原变量和反变量互换,可得到“?
”式Y中的所有和“+”互换,您选择的答案:
”关系,可以实现吸收大负载电流功能门输出并联使用形成“线与知识点:
OD您选择的答案:
在其他变量取所有值时,如果不出现您选择的答案:
异或和同或也是由与、或、非三种基本运算构成的复合运算'
加入低电平,即可立即将触发器置1或置0,而不应处于高电平。
触发器正常工作时,您选择的答案:
2n个触发器可构成一个不大于进制的计数器。
n知识点:
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