最新数字电路与数字电子技术课后答案第二章文档格式.docx
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Fi
F2
F3
F4——[Fl
3•试分析图P2.3所示电路的逻辑功能
n_:
A
T
(a
)
(b)
图P2.3
解
图
P2.3
(a)F
=AB+CD
AB
F
F=A㊉B
00
01
1
10
11
4.
电路如图
P2.4所
:
示,
为使其完成C=1时,
F=B,电路应如何改动。
当C=1时,三态门呈高阻状态,相当于断开,或非门对应输入端悬空相当于”1所示
f=B1=0,为使其完成f应在三态门输入端接一个RRoff的电阻即可,电路图如
图P2.A4所示
Fi,F2为图P2.A5
(a)图P2.5
F,=A二B
C=1时,F2为高阻状态,C=0时,冃=AB
6.改正图P2.6所示TTL电路中的错误
7.
F=A^B
(a)
F2=ABE=ABF4=AB
(b)(c)(d)
图P2.6
(a)三极管基极应加接基极电阻RB.否则与非门输出高电平3.6V时,将三极管损坏。
(b)TTL非门的输出端不能并联,应换为集电极开路门。
(C)输入端所接电阻R=20°
°
VR°
ff,相当于”0;
使F3=1,必须使R>
Roff,如取R=5K'
(d)输入端所接电阻R=5KRon相当于"
1;
使F4=1,必须使RRoff,如取R^1001,相当于”0;
这时F^=AB
8.
(e)
电路如图P2.7(a)~(f)所示,已知输入信号A,B波形如图P2.7(g)所示,试画出各个电路输入电压波形。
(g)
图P2.7
B—
Fi“1
F2
F3“1
F4“1
F5
斤=ABJ=i
E=ABD
=AB
F3=ABo=1
H=aLb_o=1
E=A[0B」=B
F6=A■0=A
F6
图P2.A7
9.电路及输入波形如图P2.8(a),(b)所示,试按A、B、C及X1,X2,X3的波形画出输出波形。
解:
0_1—1.t
b亠I!
._I——
0IXU_t
cf!
II——!
!
—!
0:
i「1i_1
>
t
0—
X|01=
I
X|\
oU
F|0L
丨).t
图P5.A5
(2)
1JL…
11」I►T图P2.8F为图P2.A8
JI
Xi=1,X2=X3=0,F=AB
x2=1,xr=x3=0,F=BCx3=1力=x2=0,F=Ci=C
画出下如图P2.A8所示
10.
CMOS电路如图P2.9(a)所示,已知输入A,B及控制端C的波形如图P2.9(b)所示,试画出Q端的波形.
当C=0时,C=i,TGi导通,TG2截止,Q=A+B
当C=1时,C=0,TGi截止,TG2导通,这时A=0,Q=B
11.
分析图P2.10所示各电路的逻辑功能
(a)F=(BS+DE)A+(A+G)EF
(b)F2二ABAB二A二B
©
F3=ABCD=ABbCD=ABCD
(C)
图P2.10
12.在CMOS门电路中,有时采用图P2.11所示的方法扩展输入端。
试分析图P2.11(a)
(b)所示电路的逻辑功能,写出F的逻辑表达式。
假定Vdd=10V,二极管的正向导通压降
Vd=°
.7V,并说明这种扩展输入端得方法能否用于TTL电路及说明原因。
图P2.11
(a)F1=ABCD
这种扩展输入端得方法不能用于TTL电路因为当扩展端C、D、E有低电平0.3V时,对
应的二极管导通,使与非门一个输入端低电位为0.3V+0.7V=1V,若多射极管T1处于深饱和
其集电极电压近似为1V,是T2导电,T4导电,输出低电平,因而逻辑关系错误,不正常工
作。
(b)E=ABCDE
这种扩展输入端的方法不适用于TTL电路因为当扩展端C、D、E均为低电平时,三个
二极管均截止,或非门的一个对应输入端通过100K"
电阻接地,此时F^-AB^0,
将输入信号A,B封锁,电路工作不正常。
12•试分析图P2.12(a),(b)电路的逻辑功能,写出y的逻辑表达式,图中门电路均为CMOS门电路,本电路能否用于TTL门电路,并说明原因。
•+10V
C
—
-
E
D
―>
丫2
b
(a)
图P2.12
(a)yr=ABCDEF二ABCDEF
本电路可以用于TTL电路,因与非门输入端有一个为3.6-0.7V=2.9V,在高电平许可范围内,当与非门输入全为
管均截止,y=0,为低电位,因此高低电平在许可范围内,而二极管具有单向导电性,也
不能出现TTL门输出端并联的情况,不会出现逻辑错误。
(b)屮二ABCLDEF二ABCDEF可用于TTL门电路,原因同上.
13•试说明下列各种门电路中有哪些输出端可以并联使用:
(1)
(2)
具有推拉式输出端的TTL门电路;
TTL电路的OC门;
(3)
TTL电路的三态门;
⑷
(5)
普通的CMOS门;
漏极开路的CMOS门;
(6)
CMOS电路的三态门.
(1)具有推拉式输出端的TTL门电路输出端不能并联,否则在一个门截止,一个门导通的情况下会形成低阻通路,损坏器件。
⑵TTL电路的OC门输出端可以并联.
⑶TTL电路的三态门输出端可以并联,但每个门必须要分时工作
⑷普通的CMOS门输出端不能并联.
⑸漏极开路的CMOS门输出端可以并联•
⑹CMOS电路的三态门输出端可以并联,但每个门需分时工作
14•试画出完成F=ABC的CMOS逻辑电路.解:
p-t-L
nr卜
卜Hk
卜
Hh
H沽L♦HJt-L
A•
B•
Vdd
图P2.A14
f二ABc二ABc
15•如图P2.13所示电路中,Gl是三态门,G2是普通TTL与非门,假定控制端C处于高电平,那么开关K合上和断开时,三态门的输出电位各为多少?
而当控制端C处于低
电平时,在K合上和断开两种情况下,三态门时输出电位又是多少?
G1
图P2.13
当C=1时,Gl门处于高阻状态,相当于输出端断开,因此在K打开时,电压表指示为
0,当K合上时,量出G2门输入端电压1.4V。
当C=0时Gi门输出为AB,电压表指示取决于A、B。
A、B中有一个为”0”则电压表为3.6V,当A=B=”1时,电压表为0.3V。
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