cameralinkv20中文版Word文件下载.docx
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1.6技术优势
1.6.1较小的连接器和线缆
28bits可以通过5个LVDS对传输,降低了接插件的大小,为更小的相机提供了可能。
1.6.2高数据传输速率
ChannelLink家族芯片的最大速率可达,符合当前传输速度不断提高的趋势
2相机信号要求
2.1介绍
主要介绍信号的定义,CameraLink线缆提供控制信号、串行通信和视频数据。
2.2视频数据
图像数据和图像数据使能在channellink总线上传输。
2.2.1CameraLinkBase/Medium/Full
CameraLinkBase/Medium/Full定义了4个使能信号,描述如下
•FVAL—场有效,高期间可以输出行有效,FVAL和第一个有效行前沿没有间隔
•LVAL—行有效,高期间可以输出数据有效,LVAL和第一个像素有效没有间隔
•DVAL—数据有效,高有效
•Spare—剩余,备用
相机上的每个channellink芯片都必须提供所有定义的使能信号,相机需保证所有未用到的数据位必须嵌位到一个已知值。
图像数据位分布请参考第四、五部分。
2.2.2CameraLinkLite
•Spare—这种配置下没有分配
相机上的每个channellink芯片都必须提供上述3个使能信号,相机需保证所有未用到的数据位必须嵌位到一个已知值。
图像数据位分布请参考第4、5章。
2.2.3CameraLink80bit
80bit配置模式使用了一些使能信号来传输数据,所有的剩余用来传输数据。
使能信号定义如下
•FVAL—场有效,高期间可以输出行有效,只提供给第一片channellink芯片
•LVAL—行有效,高期间可以输出数据有效,提供给所有channellink芯片
备注:
DVAL和Spare信号用来传输数据
相机必须给基本channellink芯片提供FVAL和LVAL信号,其他两片必须提供LVAL,其他信号用作数据。
2.3相机控制信号
2.3.1CameraLinkBase/Medium/Full
保留4个LVDS信号对,用来做通用相机控制,对采集卡来说是输出,相机是输入,相机制造商可以根据他们的产品定义这些信号。
•CameraControl1(CC1)
•CameraControl2(CC2)
•CameraControl3(CC3)
•CameraControl4(CC4)
2.3.2CameraLinkLite
保留1个LVDS信号对,用来做通用相机控制,对采集卡来说是输出,相机是输入,相机制造商可以根据他们的产品定义这个信号。
•CameraControl(CC)
2.3.3CameraLink80bit
同CameraLinkBase/Medium/Full
2.4通讯
2.4.1CameraLinkBase/Medium/Full
2个LVDS信号对,用来做相机和采集卡间的异步串行通讯,波特率至少9600。
信号包含
•SerTFG—to采集卡的差分对
•SerTC—to相机的差分对
串行接口有如下特性
一个开始位,一个停止位,没有奇偶校验,没有握手。
采集卡厂商必须提供一个API来使用这个串行通讯接口,详细参见第8章
2.4.2CameraLinkLite
1个LVDS信号对,用来做从采集卡向相机异步串行通讯,从相机到采集卡的通讯在数据的一个LVDS信号对上。
•SerTFG—to采集卡的差分对,这个信号分配到数据个差分对上,详细参见bit分配,传输速率不是时钟速率,根据相机中的波特率来定。
2.4.3CameraLink80bit
3端口分配
不同配置的命名如下:
•Lite/Base–1个ChannelLink芯片,1个线缆连接器
•Medium-2个ChannelLink芯片,2个线缆连接器
•Full/80bit-3个ChannelLink芯片,2个线缆连接器
3.1端口定义-所有配置
一个端口定位一个8位的字,LSB是bit0,MSB是bit7,。
CameraLink使用8个端口,从A-J,下表中列出了各种配置的具体情况。
Configuration
PortsSupported
NumberofChips
Numberofonnectors
Lite
A,B(upto10bitsonly)
1
Base
A,B,C
Medium
A,B,C,D,E,F
2
Full
A,B,C,D,E,F,G,H
3
80bit
A,B,C,D,E,F,G,H,I,J
3.2相机硬件布局和框图
3.2.1Base/Medium/Full配置
Figure1DataRoutingforBase,Medium,andFullConfigurations
Figure2BlockDiagramofBase,Medium,andFullConfiguration
3.2.2LiteConfigurations
Figure3DataRoutingforLiteConfigurationsPort
Figure4BlockDiagramofLiteConfiguration
3.2.380bitConfigurations
下图列出了80bit10tap/8bit的配置和布局和80bit8tap/10bit的配置和布局。
Figure5DataRoutingfor80bitConfigurations
Figure6BlockDiagramof80bit,10-tap/8-bitConfiguration
Figure7BlockDiagramof80bit,8-tap/10-bitConfiguration
4channellink芯片到接插件的位分布
4.1Base,MediumandFullConfigurations的位分布
芯片端的位分布
Pin-Name
ChipXSignal
ChipYSignal
ChipZSignal
TxCLKOut/TxCLKIn
Strobe
TX/RX24
LVAL
TX/RX25
FVAL
TX/RX26
DVAL
TX/RX23
Spare
TX/RX0
PortA0
PortD0
PortG0
TX/RX1
PortA1
PortD1
PortG1
TX/RX2
PortA2
PortD2
PortG2
TX/RX3
PortA3
PortD3
PortG3
TX/RX4
PortA4
PortD4
PortG4
TX/RX6
PortA5
PortD5
PortG5
TX/RX27
PortA6
PortD6
PortG6
TX/RX5
PortA7
PortD7
PortG7
TX/RX7
PortB0
PortE0
PortH0
TX/RX8
PortB1
PortE1
PortH1
TX/RX9
PortB2
PortE2
PortH2
TX/RX12
PortB3
PortE3
PortH3
TX/RX13
PortB4
PortE4
PortH4
TX/RX14
PortB5
PortE5
PortH5
TX/RX10
PortB6
PortE6
PortH6
TX/RX11
PortB7
PortE7
PortH7
TX/RX15
PortC0
PortF0
TX/RX18
PortC1
PortF1
TX/RX19
PortC2
PortF2
TX/RX20
PortC3
PortF3
TX/RX21
PortC4
PortF4
TX/RX22
PortC5
PortF5
TX/RX16
PortC6
PortF6
TX/RX17
PortC7
PortF7
4.2BitAllocationforthe80-Bit,10-tap/8-bitConfiguration
PortA0
PortD2
PortG5
PortA1
PortD3
PortG6
PortA2
PortD4
PortG7
PortA3
PortD5
PortH0
PortA4
PortD6
PortH1
PortA5
PortD7
PortH2
PortA6
PortE0
PortH3
PortA7
PortE1
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