硬件描述语言及应用PPT格式课件下载.ppt
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置于具体目标器件;
44、编程:
将二进制文件、编程:
将二进制文件载入载入PLDPLD器件中。
器件中。
第第88章章硬件描述语言及其应用硬件描述语言及其应用8.1概述(概述(VerilogHDL)VerilogHDLVerilogHDL程序基本结构程序基本结构modulemux2to1_GL(a,b,sel,out);
inputa,b,sel;
outputout;
wireselnot,a1,b1;
notU1(selnot,sel);
andU2(a1,a,selnot);
andU3(b1,b,sel);
orU4(out,a1,b1);
endmodule/门级模型门级模型第第88章章硬件描述语言及其应用硬件描述语言及其应用8.1概述(概述(VerilogHDL)VerilogHDLVerilogHDL程序基本结构程序基本结构modulemux2to1_GL(a,b,sel,out);
assignout=sel?
b:
a;
endmodule/数据流模型数据流模型第第88章章硬件描述语言及其应用硬件描述语言及其应用8.1概述(概述(VerilogHDL)VerilogHDLVerilogHDL程序基本结构程序基本结构modulemux2to1_GL(a,b,sel,out);
regoutalways(seloraorb)if(sel=1)out=b;
elseout=a;
endmodule/行为级模型行为级模型第第88章章硬件描述语言及其应用硬件描述语言及其应用8.2基本语法规则基本语法规则词法:
词法:
11、间隔符:
、间隔符:
空格、换行、空格、换行、TABTAB22、标识符、关键字:
、标识符、关键字:
字母或下划线开头,数字、字母、字母或下划线开头,数字、字母、下划线、下划线、$符号组成符号组成33、注释:
、注释:
/单行;
单行;
/*/*多行多行*/逻辑值:
逻辑值:
00,1,x(,1,x(不定不定)、zz(高阻)高阻)常量:
常量:
33b10112b10112h13xh13x44d10d10变量数据类型:
变量数据类型:
wirea,b;
/线网线网regc;
/寄存器寄存器m:
n/定义位宽定义位宽第第88章章硬件描述语言及其应用硬件描述语言及其应用8.3基本运算基本运算算术运算:
算术运算:
运算符:
+、-、*、/、%例例:
44b101x+4b101x+4b0111b0111,结果:
结果:
44bxxxxbxxxx相等运算:
相等运算:
=(相等)、(相等)、!
=(不等):
(不等):
运算结果为运算结果为00、11、xx。
=(全等)、!
(全等)、!
=(全不等):
运算结果为(全不等):
运算结果为00、11。
逻辑运算:
运算结果:
00、1;
1;
x:
操作数包含不定态。
其他:
位运算、缩位运算、位运算、缩位运算、位拼接运算位拼接运算第第88章章硬件描述语言及其应用硬件描述语言及其应用8.4门级建模门级建模基本门元件基本门元件VerilogHDL内置内置1212个基本门级元件个基本门级元件第第88章章硬件描述语言及其应用硬件描述语言及其应用8.4门级建模门级建模基本门的运用基本门的运用调用形式:
调用形式:
1、andA1(out,in1,in2,in3)2、notN1(out1,out2,.,in)3、bufB1(out1,ou2,.,in)4、bufif0B1(out,in,ctrl)5、notif0N1(out,in,ctrl)第第88章章硬件描述语言及其应用硬件描述语言及其应用8.4门级建模门级建模基本门的运用基本门的运用modulecircuit(A,B,L);
inputA,B;
outputL;
wirea1,a2,Anot,Bnot;
andG1(a1,A,B);
andG2(a2,Anot,Bnot);
not(Anot,A)not(Bnot,B)or(L,a1,a2)endmodule例子第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模连续赋值语句连续赋值语句assign连续赋值语句:
连续赋值语句:
moduleM1(A,B,L1,L2,L3);
input3:
0A,B;
output3:
0L1,L2,L3;
assignL1=(AB);
L3=(A=B);
endmodule第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模行为级建模基础行为级建模基础always过程语句:
过程语句:
always(敏感信号表达式敏感信号表达式)begin:
块名:
块名变量定义变量定义过程赋值过程赋值if-else条件语句条件语句case,casex,casez分支语句分支语句while,repeat,for循环语句循环语句end第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模行为级建模基础行为级建模基础例例对对4-2优先编码的建模优先编码的建模modulepriority_encode(in,out)input3:
0in;
out1:
0out;
wire3:
reg1:
always(in)begincasez(in)4b1?
:
out=2b11;
4b01?
out=2b10;
4b001?
out=2b01;
4b0001:
out=2b00;
endcaseendendmodule第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模循环语句循环语句例例8位乘法器实现位乘法器实现module_8bit_mutiplier(result,opA,opB)parameterSIZE=8,LONGSIZE=16;
/变量定义变量定义inputSIZE-1:
0opA,opB;
outputLONGSIZE-1:
0result;
wireSIZE:
/连线型变量连线型变量regLONGSIZE-1:
/寄存器型变量寄存器型变量always(opAoropB)/过程语句过程语句beging:
mult/语句块名称语句块名称intgerindex;
/3232位带符号整型变量位带符号整型变量result=0;
for(index=0;
indexSIZE;
index=index+1)if(opBindex=1)result=result+(opAindex);
/移位操作移位操作endendmodule第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模关于事件控制关于事件控制电平触发:
电平触发:
always(opAoropB)边沿触发:
边沿触发:
always(posedgeclkornegedgeclr)posedge:
保留字,上升沿保留字,上升沿negedge:
保留字,下降沿保留字,下降沿第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模阻塞赋值和非阻塞赋值阻塞赋值和非阻塞赋值阻塞赋值方式:
阻塞赋值方式:
moduleblock(c,b,a,clk)inputclk,a;
outputc,b;
regc,balways(posedgeclk)beginb=a;
c=b;
endendmodule第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模非阻塞赋值方式非阻塞赋值方式:
endendmodule阻塞赋值和非阻塞赋值阻塞赋值和非阻塞赋值第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模并发执行并发执行两个两个always语句块的并发执行:
语句块的并发执行:
endalways(posedgeclk)beginc=b;
endendmodule两个两个alwaysalways语句块,语句块,用阻塞赋值实现非阻塞用阻塞赋值实现非阻塞赋值功能。
赋值功能。
第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模并发执行并发执行模块模块1:
moduleserial_1(q,a,clk)inputclk;
outputq,a;
regq,a;
always(posedgeclk)beginq=q;
a=q;
endendmodule模块模块2:
moduleserial_2(q,a,clk)inputclk;
always(posedgeclk)begina=q;
q=q;
endendmodule第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模并发执行并发执行并行模块并行模块1:
moduleparal_1(q,a,clk)inputclk;
endalways(posedgeclk)begina=q;
endendmodule并行模块并行模块2:
moduleparal_2(q,a,clk)inputclk;
endalways(posedgeclk)beginq=q;
endendmodule第第88章章硬件描述语言及其应用硬件描述语言及其应用8.5VerilogHDL行为级建模行为级建模并发执行并发执行例例:
块语句:
beginB=A;
C=B+1;
end与:
与:
end的区别?
的区别?
在同一块语句中不能同时使在同一块语句中不能同时使用阻塞
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- 关 键 词:
- 硬件 描述 语言 应用
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