quartusII使用初步PPT文件格式下载.ppt
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- 上传时间:2022-10-22
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项目名称、顶层设计实体名称缺省使用该目录名称。
项目名称一般可任取,但顶层设计实体名称一定要与将要设计的某个文件同名。
FileNew或工具栏上的“新建”按钮在出现的“新建”界面的“DeviceDesignFiles”标签中选择“VerilogHDLFile”。
二、建立新VerilogHDL文件,输入VerilogHDL源文件,保存VerilogHDL源文件本例中的项目只有这一个文件,所以该VerilogHDL源文件的名称与该项目的顶层设计实体名称相同,当然,该VerilogHDL源文件的名称一定与它内部的实体(“Entity”)名称相同。
编译项目:
菜单Processing-StartCompilation或工具栏的编译按钮,三、编译项目,四、建立新块设计文件,使用QuartusII软件在进行数字逻辑设计时,除了可用VHDL进行设计外,还可以用“块文件”进行设计。
用块文件进行数字逻辑设计一般就是用电子元器件进行设计,也即电路原理图设计。
下面的例子介绍如何用块文件进行数字逻辑设计。
在这个例子中,要实现的功能是这样的:
ABandC,指定项目目录、名称等,建立块文件在新建文件的“DeviceDesignFiles”标签中选中“BlockDiagram/SchematicFile”,块文件编辑窗口为输入元器件,鼠标双击任意空白处。
输入元器件的界面,输入或查找元器件输入“and2”,点击“OK”按钮结束。
输入完“and2”器件后的界面,输入“input”引脚,输入完所需的所有器件后的界面,连接器件,为输入、输出引脚命名双击要命名的输入或输出引脚,在出现的界面中的“Pinname”栏中为器件指定名称。
指定完所有名称后的界面,保存块文件并编译项目:
菜单Processing-StartCompilation或工具栏的编译按钮,建立波形文件为进行仿真需要建立波形文件。
在“新建文件”的“OtherFiles”标签栏中选择VectorWaveformFile”。
五、仿真,波形文件编辑器界面,输入“节点”:
在左侧空白栏处点击鼠标右键选择InsertNodeorBus;
或在空白处双击鼠标,输入“节点”界面点击“NodeFinder”按钮,查询节点界面(注意,fliter要选择Pin:
all)点击“Start”按钮查询节点,查找后的界面被查找到的节点列在左侧栏中。
本例中要使用所有节点,点击“”按钮把所有节点选中。
选中完节点后的界面点击“OK”按钮结束。
节点查找完成后的界面点击“OK”按钮结束。
节点插入完成后的界面,为输入节点指定波形选中“Pin”节点的10ns到20ns部分,然后点击左侧的“1”。
为“Pin”指定完波形的界面,保存波形文件,仿真分类,功能仿真时序仿真在菜单Assignments-Settings-Simulator-SimulationMode中选择Functional或Timing,功能仿真,先要生成功能仿真的网表ProcessingGenerateFunctionalStimulationNetlist,点击工具栏上的“仿真”按钮。
仿真后的波形文件,编译项目后进行仿真,时序仿真,为项目指定器件及分配器件的引脚,七、分配器件及引脚,六DE2板的使用连接,参见DE2使用手册DE2板的结构及连接Page4-10DE2板上开关,按键,LED灯,时钟的控制引脚号及控制方法参见Page26-29,指定器件族(Family)本例使用CYCLONEII器件族,指定具体器件(AvailableDevices)本例使用EP1C6Q240C8器件,分配引脚AssignmentsAssignmenteditor得到上图界面,指定具体引脚点击PIN,在TO选框内加入引角,并指定引角号(编译),打开“Programmer(Tools菜单中或工具栏中的快捷方式),八、下载文件到开发板,下载文件界面如果现在硬件没有设置,要首先设计现在硬件:
点击“HardwareSetup”按钮。
(后面是Quartus5.0的设置方式,8.0不需设置),下载硬件设置界面点击“AddHardware”按钮。
选择硬件选择“ByteBlasterMVorByteBlasterII”,点击“OK”结束。
添加完下载硬件后的界面添加完下载硬件,如“Currentselectd”还是显示“Nohardware”,则点击下拉框,选择ByteBlasterII,下载硬件设置完成后的界面在“Type:
”后显示了下载硬件。
为添加下载文件,点击“AddFile”按钮。
添加文件界面在本例的项目目录中选择扩展名为“.sof”的文件,点击“打开”按钮。
下载文件点击“Program/Config”复选框,然后点击“Start”按钮。
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