最新数字系统设计与PLD应用答案Word文档格式.docx
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(1).DFF状态编码
A—000B—001C—010D—011E—100
输出:
AOUTGQ^BOUTQQQCOUT
SETOU©
QG
(2)“一对一”状态分配
AQ。
BQCQd—Q3eq
次态表:
NS
PS
输入条件
Z
C
X
E
D
-
激励方程:
D0=Q0ZQ2XQ4XD广D2=QZQ2XD^Q1ZD^QzQ4X
输出:
AOUT二Qobout=qcoutdoutsetou=qx
3.2、试给出一位全减器的算法描述和数据流描述真值表:
x
y
bi
d
bo
1
x—被减数y—减数bi—低位向本位的借位d—差bo—本位向高位的借位
LIBRARYIEEE;
USEIEEE.Std_Logic_1164.ALL;
ENTITYfull_subIS
PORT(x,y,bi:
INStd_Logic;
d,bo:
OUTStd_Logic);
ENDfull_sub;
算法描述:
ARICHITECTUREalg_fsOFfull_subIS
BIGIN
PROCESS(x,y,bi)
BEGIN
IF(x='
O'
ANDy='
ANDbi='
OR尸“1AND
ANDbi=
‘1'
ORx='
1'
ANDy='
1'
ANDbi=‘O'
)THEN
bo<
=
'
O'
;
d<
‘O'
;
ELSIF(x=
ANDy=
)THEN
‘0'
j'
ELSE
ENDIF;
ENDPROCESSc1;
ENDalg_fs;
数据流描述:
(d=x®
y®
bibo=x'
y+x'
bi+ybi)
ARICHITECTUREdataflow_fsOFfull_subISBEGIN
d<
=xXORyXORbi;
=(NOTxANDy)OR(NOTxANDbi)OR(yANDbi);
ENDdataflow_ha;
3.4、
(1).十进制-BCD码编码器,输入、输出均为低电平有效。
ENTITYencoderIS
PORT(a:
INStd_Logic_Vector(9DOWNTO0)
b:
OUTStd_Logic_Vector(3DOWNTO0));
ENDencoder;
ARCHITECTUREbeh_encoderOFencoderISBEGIN
WITHaSELECT
b<
=“
0110”
WHEN“0111111111
0111”
WHEN
“1011111111”,
1000”
“1101111111”,
1001”
“1110111111”,
1010”
“1111011111”,
1011”
“1111101111”,
1100”
“1111110111”,
1101”
“1111111011”,
1110”
“1111111101”
1111”
“1111111110”
0000”
WHENOTHERS;
ENDbeh_encoder;
补充:
优先编码器LIBRARYIEEE;
WHEN“0XXXXXXXXX”,
“10XXXXXXXX”,
“110XXXXXXX”,
“1110XXXXXX”,
“11110XXXXX”,
“111110XXXX”,
“1111110XXX”,
“11111110XX”,
“1110”WHEN“111111110X
“1111”WHEN“1111111110
0000”WHENOTHERS;
(2).时钟RS触发器。
Q
ENTITYclk_rs_ffIS
P0RT(r,s,cp:
INStd_Logic;
q,nq:
BUFFERStd_Logic);
ENDclk_rs_ff;
ARCHITECTUREbeh_clkrsffOFclk_rs_ffISBEGIN
ASSERTNOT(r='
1‘ANDs='
)
REPORT"
Controlerror"
SEVERITYError;
PROCESS(r,s,cp)
IFcp='
THEN
q<
=sOR(NOTrANDq);
nq<
=NOT(sOR(NOTrANDq));
ENDIF;
ENDPROCESS;
ENDbeh_clkrsff;
S
-■
J
1J
CP_
—a
〉C1
K
1K
R
r-1
(3)
:
一Q
.带复位端、置位端、延迟为15ns的响应CP下降沿的JK触发器。
ENTITYjk_ffIS
GENERIC(tpd:
Time:
=15ns);
FORT(r,s,j,k,cp:
q,nq:
BUFFEERStd_Logic);
ENDjk_ff;
ARCHITECTUREbeh_jkffOFjk_ffIS
ASSERTNOT(r='
0‘ANDs='
0'
REPORT"
PROCESS(r,s,cp)
IFr=‘O'
=‘0'
AFTERtpd;
='
ELSIFs=‘0'
qv=‘1'
ELSIF(cp'
EventANDcp=‘0'
)THEN
qv=jANDnqORNOTkANDqAFTERtpd;
nqv=NOT(jANDnqORNOTkANDq)AFTERtpd;
ENDbeh_jkff;
(4).集成计数器74161。
Cfl—c
LD^-
CTf—
Cf3—
CIKD1V165CT=0Ml
G3Z
G4
>
C5/2,3t4+
匚
1,5D⑴
Dl
第A
it
CP
臣
CTp
CTt
Di
5
Q】
Qi
Qd
i
c
9
鬲
01
圳
伽
果
特
ft
—CO
USEIEEE.Std_Logic_Unsigned.ALL;
ENTITYcounter16IS
PORT(cr.Id,cp,ctt,ctp:
d:
INStd_Logic_Vector(3DOWNTO0);
q:
BUFFERStd_Logic_Vector(3DOWNTO0);
co:
OUTBit);
ENDcounter16;
ARCHITECTUREbehav_ctr16OFcounter16IS
PROCESS(cr,cp)
IFcr='
=“0000”;
ELSIF(cp'
EventANDcp='
IFld='
0'
qv=d;
ELSIF(ctt='
ANDctp='
IFq=“1111"
THEN
qv=“0000”;
qv=q+“0001”;
co<
WHEN(q=“1111”ANDctt='
)ELSE'
0
ENDbeh_ctr16;
(5)•集成移位寄存器74194。
LIBRARYIEE
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