MSPG习笔记数据手册Word下载.doc
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具有四种校准频率并高达16MHz的内部频率;
内部超低功耗LF振荡器;
32.768KHz晶体;
外部数字时钟源。
两个16位Timer_A,分别具有三个捕获/比较寄存器。
用于模拟信号比较功能或者斜率模数(A/D)转换的片载比较器。
带内部基准、采样与保持以及自动扫描功能的10位200-ksps模数(A/D)转换器。
16KB闪存,512B的RAM。
16个I/O口。
注意:
MSP430G2553无P3口!
MSP430G2553的时钟
基本时钟系统的寄存器
DCOCTL-DCO控制寄存器
DCOx
DCO频率选择控制1
MODx
DCO频率校正选择,通常令MODx=0
在MSP430G2553上电复位后,默认RSEL=7,DCO=3,通过数据手册查得DCO频率大概在0.8~1.5MHz之间。
BCSCTL1-基本时钟控制寄存器1
XT2OFF
不用管,因为MSP430G2553内部没有XT2提供的HF时钟
XTS
不用管,默认复位后的0值即可
DIVAx
设置ACLK的分频数
00 /1
01 /2
10 /4
11 /8
RSELx
DCO频率选择控制2
BCSCTL2-基本时钟控制寄存器2
SELMx
MCLK的选择控制位
00 DCOCLK
01 DCOCLK
10 LFXT1CLK或者VLOCLK
11 LFXT1CLK或者VLOCLK
DIVMx
设置MCLK的分频数
SELS
SMCLK的选择控制位
0 DCOCLK
1 LFXT1CLK或者VLOCLK
DIVSx
设置SMCLK的分频数
DCOR
DCO直流发生电阻选择,此位一般设0
0 内部电阻
1 外部电阻
BCSCTL3-基本时钟控制寄存器3
XT2Sx
不用管
LFXT1Sx
00 LFXT1选为32.768KHz晶振
01 保留
10 VLOCLK
11 外部数字时钟源
XCAPx
LFXT1晶振谐振电容选择
00 1pF
01 6pF
10 10pF
11 12.5pF
msp430g2553.h中基本时钟系统的内容
/************************************************************
*BasicClockModule
************************************************************/
#define__MSP430_HAS_BC2__/*DefinitiontoshowthatModuleisavailable*/
SFR_8BIT(DCOCTL);
/*DCOClockFrequencyControl*/
SFR_8BIT(BCSCTL1);
/*BasicClockSystemControl1*/
SFR_8BIT(BCSCTL2);
/*BasicClockSystemControl2*/
SFR_8BIT(BCSCTL3);
/*BasicClockSystemControl3*/
#defineMOD0(0x01)/*ModulationBit0*/
#defineMOD1(0x02)/*ModulationBit1*/
#defineMOD2(0x04)/*ModulationBit2*/
#defineMOD3(0x08)/*ModulationBit3*/
#defineMOD4(0x10)/*ModulationBit4*/
#defineDCO0(0x20)/*DCOSelectBit0*/
#defineDCO1(0x40)/*DCOSelectBit1*/
#defineDCO2(0x80)/*DCOSelectBit2*/
#defineRSEL0(0x01)/*RangeSelectBit0*/
#defineRSEL1(0x02)/*RangeSelectBit1*/
#defineRSEL2(0x04)/*RangeSelectBit2*/
#defineRSEL3(0x08)/*RangeSelectBit3*/
#defineDIVA0(0x10)/*ACLKDivider0*/
#defineDIVA1(0x20)/*ACLKDivider1*/
#defineXTS(0x40)/*LFXTCLK0:
LowFreq./1:
HighFreq.*/
#defineXT2OFF(0x80)/*EnableXT2CLK*/
#defineDIVA_0(0x00)/*ACLKDivider0:
/1*/
#defineDIVA_1(0x10)/*ACLKDivider1:
/2*/
#defineDIVA_2(0x20)/*ACLKDivider2:
/4*/
#defineDIVA_3(0x30)/*ACLKDivider3:
/8*/
#defineDIVS0(0x02)/*SMCLKDivider0*/
#defineDIVS1(0x04)/*SMCLKDivider1*/
#defineSELS(0x08)/*SMCLKSourceSelect0:
DCOCLK/1:
XT2CLK/LFXTCLK*/
#defineDIVM0(0x10)/*MCLKDivider0*/
#defineDIVM1(0x20)/*MCLKDivider1*/
#defineSELM0(0x40)/*MCLKSourceSelect0*/
#defineSELM1(0x80)/*MCLKSourceSelect1*/
#defineDIVS_0(0x00)/*SMCLKDivider0:
#defineDIVS_1(0x02)/*SMCLKDivider1:
#defineDIVS_2(0x04)/*SMCLKDivider2:
#defineDIVS_3(0x06)/*SMCLKDivider3:
#defineDIVM_0(0x00)/*MCLKDivider0:
#defineDIVM_1(0x10)/*MCLKDivider1:
#defineDIVM_2(0x20)/*MCLKDivider2:
#defineDIVM_3(0x30)/*MCLKDivider3:
#defineSELM_0(0x00)/*MCLKSourceSelect0:
DCOCLK*/
#defineSELM_1(0x40)/*MCLKSourceSelect1:
#defineSELM_2(0x80)/*MCLKSourceSelect2:
XT2CLK/LFXTCLK*/
#defineSELM_3(0xC0)/*MCLKSourceSelect3:
LFXTCLK*/
#defineLFXT1OF(0x01)/*Low/highFrequencyOscillatorFaultFlag*/
#defineXT2OF(0x02)/*Highfrequencyoscillator2faultflag*/
#defineXCAP0
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