1-数字电子设计部分六进制同步减法计数器Word文档格式.doc
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1.2.5实际电路图 9
1.2.6实验仪器 10
1.2.7实验结论 10
1.3四位二进制同步加法计数器(0010) 10
题目二四位二进制同步加法计数器(0010) 10
1.3.1课程设计的目的 10
1.3.2设计的总体框图 10
1.3.3设计过程 10
1.3.4逻辑电路图 13
1.3.5实际电路图 13
1.3.6实验仪器 13
1.3.7实验结论 13
1.3.8参考文献 14
1数字电子设计部分
1.1数字电子技术课程设计报告(自动化专业)
题目一六进制同步减法计数器(无效态:
010,011)
1.1.1课程设计的目的
1、了解同步减法计数器工作原理和逻辑功能。
2、掌握计数器电路的分析,设计方法及应用。
3、学会正确使用JK触发器。
1.1.2设计的总体框图
CP六进制同步
减法计数器
Y
1.1.3设计过程
(1)状态图:
000
001
100
101
110
111
/0
/0
/1
(2)选择的触发器名称:
选用三个CP下降沿触发的边沿JK触发器
(3)输出方程:
Y=
(4)状态方程:
Qn1Q0n
Q2n
00
01
11
10
×
1
000110
图1.1.1六进制同步减法计数器的次态卡诺图
、
Q1nQ0n
图1.1.2Q2n+1的卡诺图
Q1nQ0n
图1.1.3Q1n+1的卡诺图
图1.1.4Q0n+1的卡诺图
由卡诺图得出状态方程为:
=
=+
=
(5)驱动方程:
===1
===1
(6)判断能否自启动
010→011→001
所以能进行自启动
1.1.4逻辑电路图
图1.1.5逻辑电路图
1.1.5实际电路图
图1.1.6实际电路图
1.1.6实验仪器
(1)数字原理实验系统一台
(2)集成电路芯片:
74LS112二片74LS08一片74LS00一片
1.1.7实验结论
经过实验可知,满足时序图的变化,产生111→110→101→100→001→000→111的序列。
1.2序列发生器的设计(检测序列101110)
题目二序列发生器的设计(序列101110)
1.2.1课程设计的目的
1、了解序列发生器的工作原理和逻辑功能
2、掌握序列发生器电路的分析,设计方法及应用。
1.2.2设计的总体框图
序列发生器
CPY
输入脉冲串行序列输出
1.2.3设计过程
1.状态图:
/1
1.状态方程
所以得到Y=
图1.2.1六进制同步减法计数器的次态卡诺图
图1.2.2Q2n+1的卡诺图
图1.2.3Q1n+1的卡诺图
图1.2.4Q0n+1的卡诺图
(7)驱动方程:
(8)判断能否自启动
1.2.4逻辑电路图
图1.2.5逻辑电路图
1.2.5实际电路图
图1.2.6实际电路图
1.2.6实验仪器
(3)数字原理实验系统一台
(4)集成电路芯片:
1.2.7实验结论
经过实验可知,满足时序图的变化,产生101110的序列。
1.3四位二进制同步加法计数器(0010)
题目二四位二进制同步加法计数器(0010)
1.3.1课程设计的目的
1、了解同步加法计数器工作原理和逻辑功能。
1.3.2设计的总体框图
CP4位二进制同步
加法计数器
1.3.3设计过程
(1)状态图:
0000→0001→0011→0100→0101→0110→0111→1000→1001→1010→1011→1100→1101→1110→1111
(2)选择的触发器名称:
选用四个CP下降沿触发的边沿JK触发器
Y=
(4)状态方程:
0001
0011
1000
0101
0110
0111
1101
1110
0000
1111
1001
1010
1100
1011
图1.3.14位二进制同步加法计数器的次态卡诺图
图1.3.2的卡诺图
图1.3.3Q2n+1的卡诺图
图1.3.4Q1n+1的卡诺图
图1.3.5Q0n+1的卡诺图
=
=
=+
(5)驱动方程:
====1
====
1.3.4逻辑电路图
图1.3.5逻辑电路图
1.3.5实际电路图
图1.3.6实际电路图
1.3.6实验仪器
(5)数字原理实验系统一台
(6)集成电路芯片:
74LS112二片74LS08一片74LS10一片74LS11一片
1.3.7实验结论
经过实验可知,满足时序图的变化,产生0000→0001→0011→0100→0101→0110→0111→1000→1001→1010→1011→1100→1101→1110→1111的序列。
1.3.8参考文献
[1]余孟尝《数字电子技术基础简明教程》高等教育出版社2007年12月
[2]张利萍,王向磊《数字逻辑实验指导书》信息学院数字逻辑实验室
[3]杨素行主编高等教育出版社《模拟电子技术基础简明教程第三版》
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- 关 键 词:
- 数字 电子设计 部分 六进制 同步 减法 计数器